专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]数据保存方法、恢复方法、系统、设备及可读存储介质-CN202310986954.3在审
  • 尤树华;施雷;刘阳 - 苏州盛科通信股份有限公司
  • 2023-08-07 - 2023-10-24 - G06F11/14
  • 本发明公开了一种数据保存方法、恢复方法、系统、设备及介质,该数据保存方法包括:创建包括多个表项的数据表,每个表项包括一个数据缓存区及对应的桶;生成与数据表中的表项对应的索引编码,将索引编码存入对应的表项的桶中;将数据库结构中的业务数据写入对应表项;将数据表中的数据写入磁盘中。该数据恢复方法包括:判断交换机是否为热重启方式;若是,则读取交换机磁盘中数据表中的数据并将数据写入数据表;基于每个数据缓存区的索引编码,读取数据缓存区中的业务数据,基于映射关系,将业务数据恢复至数据库结构。本发明提供的方法,在无需数据库的情况下,完成交换机系统软件重启前后的数据保存与恢复,可以满足所有交换机系统的使用场景。
  • 数据保存方法恢复系统设备可读存储介质
  • [发明专利]堆叠系统nexthop资源分配的方法及应用-CN202310950692.5在审
  • 陈晨;尤树华;叶家林;武帅 - 苏州盛科通信股份有限公司
  • 2023-07-31 - 2023-09-12 - H04L45/02
  • 本发明公开了一种堆叠系统nexthop资源分配的方法及应用,该方法包括以下步骤:备交换机在SDK适配层接收主交换机的适配层发送的路由表项和nexthop表项,其中,所述nexthop表项包括第一nexthopID;所述备交换机将所述路由表项和所述nexthop表项发送到对应芯片层,并将所述第一nexthop ID发送到对应适配层;所述备交换机在适配层将所述第一nexthopID保存到创建的临时nexthop表项中,并通过所述第一nexthopID占用nexthopID资源池;以及所述备交换机在适配层查找到临时nexthop表项时,将所述临时nexthop表项中的第一nexthopID更新到nexthop表项中。该方法能够保证堆叠系统中主交换机和备交换机分配到相同的nexthopID。
  • 堆叠系统nexthop资源分配方法应用
  • [发明专利]热重启下基于字段ID的软件数据结构保存及恢复的方法-CN202310321615.3在审
  • 施雷;尤树华;梁芳;钱举 - 苏州盛科通信股份有限公司
  • 2023-03-29 - 2023-08-11 - G06F8/656
  • 本发明公开了一种热重启下基于字段ID的软件数据结构保存及恢复的方法,该方法包括以下步骤:为软件的数据结构的每个字段分配一个字段ID;按照字段ID+字段长度+字段内容的顺序来保存所述数据结构,将所述字段的数据项保存至软表中。且在热重启后对所述数据结构进行恢复:查找所述数据结构中的每个字段对应的字段ID;根据所述字段ID,在热重启前保存的软表中查找对应的数据项;查询所述数据项对应的字段长度,对比所述字段长度和当前版本软件中字段长度;以及若长度不一致,根据当前版本软件的软件策略对该字段执行字段内容的转换和数据恢复的操作。该方法能够自动适应软件数据结构字段变化,实现软件的平滑升级。
  • 热重启下基于字段id软件数据结构保存恢复方法
  • [发明专利]一种降低芯片Pipeline时间戳总线位宽的方法及应用-CN202211666308.0在审
  • 尤树华;蒋震;陈晨;韦健 - 苏州盛科通信股份有限公司
  • 2022-12-23 - 2023-04-18 - H04L7/00
  • 本发明公开了一种降低芯片Pipeline时间戳总线位宽的方法,该方法包括以下步骤:当入方向的时间戳捕获模块捕捉到M位入方向时间戳时,将所述M位入方向时间戳的低位N位入方向时间戳编码到报文信息总线中,其中N小于M;所述出方向的时间戳捕获模块向时钟引擎发送捕获信号,所述时钟引擎捕捉到M位出方向时间戳并传入时间戳转换模块;所述时间戳转换模块基于M位出方向时间戳和所述报文信息总线中低位N位入方向时间戳转换得到M位入方向时间戳;以及报文编辑模块接收所述M位入方向时间戳,并将所述M位入方向时间戳编辑到报文预先定义的位置。该方法能够有效降低交换芯片携带的时间戳的pipeline总线宽度。
  • 一种降低芯片pipeline时间总线方法应用
  • [发明专利]基于容忍机制的环回检测方法及系统-CN201910156074.7有效
  • 吴林旭;刘阳;尤树华 - 苏州盛科通信股份有限公司
  • 2019-03-01 - 2022-04-22 - H04L43/08
  • 本发明提供了一种基于容忍机制的环回检测方法及系统,所述环回检测方法包括:接口对外周期性发送检测报文,检测网络中是否存在环路;若接口接收到检测报文,则判定环路存在,根据容忍机制进行环路容忍或环路处理;若接口未接收到检测报文,则判定环路不存在。本发明通过引入容忍机制,容忍机制可通过设置容忍时间或一定时间内接收到检测报文的阈值来实现,能够对网络中存在时间较短的环路进行容忍,避免了对应接口下网络环境的影响,大大提高了环回检测的容错性。
  • 基于容忍机制检测方法系统

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