[发明专利]继电器保护电路在审

专利信息
申请号: 201811589075.2 申请日: 2018-12-25
公开(公告)号: CN109509680A 公开(公告)日: 2019-03-22
发明(设计)人: 李阳海;李书锋 申请(专利权)人: 深圳和而泰小家电智能科技有限公司
主分类号: H01H47/18 分类号: H01H47/18
代理公司: 广州华进联合专利商标代理有限公司 44224 代理人: 李文渊
地址: 518100 广东省深圳市光明新*** 国省代码: 广东;44
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摘要:
搜索关键词: 继电器 继电器驱动模块 继电器保护电路 半导体开关 延时模块 主控模块 保护继电器 电源模块 延时关断 粘连 关断 充电 火花 存储
【权利要求书】:

1.一种继电器保护电路,其特征在于,包括:

电源模块、半导体开关和继电器,所述电源模块包括交流电源,所述半导体开关的第一端通过所述交流电源连接交流负载的一端,第二端连接所述继电器的第一端,所述继电器的第二端连接所述交流负载的另一端,当所述继电器和所述半导体开关相继闭合时,所述继电器、所述半导体开关、所述交流电源和所述交流负载形成闭合回路,以使所述交流负载通电;

所述继电器保护电路还包括主控模块、延时模块和继电器驱动模块;

所述继电器驱动模块用于控制所述继电器的导通与关断;

所述主控模块用于在第一时段控制所述延时模块导通,以使所述延时模块充电并使所述继电器驱动模块导通,在第二时段控制所述半导体开关导通,以使所述交流负载通电,其中,所述第二时段在所述第一时段之后;

当所述交流负载通电且所述主控模块失效时,所述半导体开关在所述交流电源过零点时关断,所述延时模块用于对所述继电器驱动模块充电,所述继电器驱动模块延时关断,以使所述继电器延迟于所述半导体开关关断。

2.根据权利要求1所述的继电器保护电路,其特征在于,还包括过零检测模块,所述过零检测模块连接所述交流电源,用于在所述第二时段输出零点信号至所述主控模块,以使所述主控模块控制所述半导体开关在所述交流电源过零点时导通。

3.根据权利要求2所述的继电器保护电路,其特征在于,还包括半导体控制模块,所述半导体控制模块一端连接所述主控模块,另一端连接所述半导体开关,当所述主控模块失效时,所述主控模块输出失效信号,所述半导体控制模块接收所述失效信号并断开,以使所述半导体开关关断。

4.根据权利要求1-3中任一项所述的继电器保护电路,其特征在于,所述电源模块还包括第一直流电源,所述继电器驱动模块包括第一开关单元和保护单元,所述第一开关单元的控制端连接所述延时模块的一端,所述第一开关单元的第一端连接所述第一直流电源,所述第一开关单元的第二端连接所述继电器的线圈和所述保护单元的一端,所述保护单元的另一端接地,当所述第一开关单元导通时,所述继电器连接所述第一直流电源,并在所述第一直流电源的作用下导通。

5.根据权利要求4所述的继电器保护电路,其特征在于,所述电源模块还包括第二直流电源,所述延时模块包括第二开关单元和充放电单元,所述第二开关单元的控制端连接所述主控模块,所述第二开关单元的第一端连接所述第二直流电源,所述第二开关单元的第二端连接所述充放电单元的一端,所述充放电单元的另一端连接所述第一开关单元的控制端,当所述第二开关单元在所述主控模块作用下导通时,所述第二直流电源对所述充放电单元充电,且所述第二直流电源控制所述第一开关单元导通。

6.根据权利要求5所述的继电器保护电路,其特征在于,所述过零检测模块包括电阻R1、钳位二极管D1、钳位二极管D2和电容C1,所述电阻R1的一端连接所述交流电源,另一端分别连接所述钳位二极管D1的阳极、所述钳位二极管D2的阴极、所述电容C1的一端和所述主控模块,所述钳位二极管D1的阴极连接所述第二直流电源,所述钳位二极管D2的阳极和所述电容C1的另一端分别接地。

7.根据权利要求6所述的继电器保护电路,其特征在于,所述半导体控制模块包括电阻R2和电容C2,所述电阻R2的一端连接所述主控模块,另一端连接所述电容C2的一端,所述电容C2的另一端连接所述半导体开关。

8.根据权利要求7所述的继电器保护电路,其特征在于,所述第一开关单元包括晶体管Q1,所述保护单元包括二极管D3,所述晶体管Q1的控制端连接所述充放电单元的一端,所述晶体管Q1的第一端连接所述第一直流电源,所述晶体管Q1的第二端连接所述继电器的线圈和所述二极管D3的阳极,所述二极管D3的阴极接地。

9.根据权利要求8所述的继电器保护电路,其特征在于,所述第二开关单元包括晶体管Q2,所述晶体管Q2的控制端连接所述主控模块,所述晶体管Q2的第一端连接所述第二直流电源,所述晶体管Q2的第二端连接所述充放电单元的一端。

10.根据权利要求9所述的继电器保护电路,其特征在于,所述充放电单元包括至少一个电容,所述至少一个电容的一端均连接所述晶体管Q1的控制端和所述晶体管Q2的第二端,所述至少一个电容的第二端均连接所述晶体管Q1的第一端。

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