[发明专利]一种基于SDH传输系统的数据校验方法和装置在审

专利信息
申请号: 201410852024.X 申请日: 2014-12-31
公开(公告)号: CN104618055A 公开(公告)日: 2015-05-13
发明(设计)人: 张磊;窦晓光;杨恩山;甯青松;耿雄飞;许建卫;刘立 申请(专利权)人: 曙光信息产业(北京)有限公司
主分类号: H04L1/00 分类号: H04L1/00;H04J3/16
代理公司: 北京德恒律治知识产权代理有限公司 11409 代理人: 章社杲;卢军峰
地址: 100193 北京*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 基于 sdh 传输 系统 数据 校验 方法 装置
【说明书】:

技术领域

发明涉及数据处理领域,具体来说,涉及一种基于SDH传输系统的数据校验方法和装置。

背景技术

在高速数据通讯系统中,由于数据流(包括有效负载和控制流)在线路上传输时会因射线、温度等外界因素的干扰,发生接收方收到的数据流与发送方发出的数据流不一致的现象。为了保证接收方能识别出错误的数据流并通知发送方线路上出现误码,则需要对通信过程进行差错控制。

目前,在线路上使用的差错控制方法有ARQ(自动请求重传方式)、FEC(前向纠错方式)和HEC(混合纠错),常用的是ARQ方式,ARQ方式的差错控制只需要检错功能使用起来简单方便。

其中,CRC循环冗余校验码(Cyclic Redundancy Check)是数据通信领域中最常用的一种差错校验码,其特征是信息字段和校验字段的长度可以任意选定。由于其误码监测能力强,抗干扰能力优异,被广泛的用于线路的差错控制。

生成CRC码的基本原理:任意一个由二进制位串组成的代码都可以和一个系数仅为‘0’和‘1’取值的多项式一一对应。例如:代码1010111对应的多项式为x6+x4+x2+x+1,而多项式为x5+x3+x2+x+1对应的代码101111。

CRC码集选择的原则:若设码字长度为N,信息字段为K位,校验字段为R位(N=K+R),则对于CRC码集中的任一码字,存在且仅存在一个R次多项式g(x),使得:

V(x)=A(x)g(x)=xRm(x)+r(x);

其中:m(x)为K-1次信息多项式,r(x)为R-1次校验多项式,

g(x)称为生成多项式:

g(x)=g0+g1x1+g2x2+...+g(R-1)x(R-1)+gRxR

发送方通过指定的g(x)产生CRC码字,接收方则通过该g(x)来验证收到的CRC码字。

下面列出了一些标准的CRC和其多项式:

CRC-4:X4+X+1

CRC-12:x12+x11+x3+x+1

CRC-16:x16+x15+x2+1

CRC-ITU:x16+x12+x5+1

CRC-32:x32+x26+x23+...+x2+x+1

CRC-32c:x32+x28+x27+...+x8+x6+1

目前在以太网中,可以通过CRC来对发送的数据流进行校验,但是在SDH传输系统中还没有一种数据流的校验机制。

在SDH传输系统中,例如OC192-c系统,C-4-64c容器中填充的帧(PPP、HDLC等类型)长度最小长度可以为24字节,但是相对以太网系统来说,减小了40字节,也就是说,OC192-c相对于10G以太网来说,位宽一致、频率一致的情况下,OC192-c系统校验每个帧的CRC周期数要短近2倍;另一方面,以太网帧间隔为平均12字节,也就是说第N帧与第N+1帧之间在64bit系统中至少存在一周期的间隔,而OC192-c系统帧间隔最小为1个字节,对于CRC校验来说,其校验间隔相比以太网的CRC的校验要减少近2个周期,而通用CRC校验模块至少要存在一个周期的初始化周期,若没有初始化周期,则校验下一帧则会出现校验电路异常或出错的问题。

综上所述,在SDH传输系统中,线速CRC校验电路的实现难度较大,因此目前还没有一种数据流的校验机制应用在SDH传输系统中。

针对相关技术中的问题,目前尚未提出有效的解决方案。

发明内容

针对相关技术中的问题,本发明提出一种基于SDH传输系统的数据校验方法和装置,能够实现在SDH传输系统中对数据流产生误码的情况进行校验。

本发明的技术方案是这样实现的:

根据本发明的一个方面,提供了一种基于SDH传输系统的数据校验方法,该方法包括:

将数据帧分割为i个部分,i≥3,其中,第1部分和第i部分的大小小于其他部分;

将分割后的数据帧存入异步缓存装置,其中,存入异步缓存装置的数据帧在异步缓存装置中读写时钟异步,且位宽相同;

将异步缓存装置中的数据帧按预定规则进行重组并对重组后的数据帧进行校验。

另外,上述方法中的SDH传输系统包括:OC192-c系统、OC12-c系统、OC48-c系统、OC768-c系统。

其中,异步缓存装置的读写时钟比k1大于处理开销比k2;

其中,读写时钟比k1为异步缓存装置的写端时钟与读端时钟的比;

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