[实用新型]一种可有效减小压控振荡器输出频率变化的电路有效

专利信息
申请号: 201320231969.0 申请日: 2013-05-02
公开(公告)号: CN203206215U 公开(公告)日: 2013-09-18
发明(设计)人: 李旺 申请(专利权)人: 成都国腾电子技术股份有限公司
主分类号: H03L7/099 分类号: H03L7/099
代理公司: 成都金英专利代理事务所(普通合伙) 51218 代理人: 袁英
地址: 610041 四*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 有效 减小 压控振荡器 输出 频率 变化 电路
【说明书】:

技术领域

实用新型涉及一种可有效减小压控振荡器输出频率变化的电路。

背景技术

随着集成电路技术的快速发展,为无线收发机系统高度集成提供了可能。集成的压控振荡器VCO和频率合成器是无线收发机系统中非常重要和关键的部件。频率合成技术,就是将一个(或多个)基准频率变换成一个(或多个)合乎质量要求的所需频率的技术,实现频率合成的电路或组件叫做频率合成器。

目前,随着集成度的提高,已经将压控振荡器VCO置于芯片中,构成频率源;由于目前置于芯片中的LC VCO类结构的电源抑制比较差,导致LC VCO的输出频率会随着电源的波动而出现变化(在单位电源电压波动范围内,LC VCO输出频率的变化值被称为Pushing),Pushing值越小,代表在电源波动的条件下,VCO输出信号频率变化越小。

为了保证系统工作的稳定性,必须要保持VCO输出频率的稳定性。目前,传统减小VCO输出pushing的方法多是通过内部做基准电路或LDO电路等来实现,然而,增加基准电路和LDO电路在工艺上的要求非常高,这将大大提高系统成本,考虑到消费类产品的价格成本因素,这类传统产品的市场竞争力较差。

实用新型内容

本实用新型的目的在于克服现有技术的不足,提供一种电路结构简单,实现方便,且可以降低LDO输出电压波动对VCO输出频率所造成的影响的可有效减小压控振荡器输出频率变化的电路。

本实用新型的目的是通过以下技术方案来实现的:一种可有效减小压控振荡器输出频率变化的电路,它包括稳压源、跟随电路和压控振荡器,跟随电路由运算放大器组成;稳压源的一路输出与压控振荡器的电源端连接,稳压源的另一路输出与运算放大器的正电源端相连;运算放大器的同相输入端连接控制电压,运算放大器的反相输入端与运算放大器的输出端相连接,运算放大器的输出端与压控振荡器的控制电压端连接。

稳压源、压控振荡器及运算放大器共地。

本实用新型的有益效果是:

1)LDO输出电压分别为运算放大器和VCO核心模块供电,且LDO、VCO及运算放大器共地,在LDO输出电压略有波动时,电压波动对可变电容两端产生几乎同样的影响,两者相互近似抵消,可以有效减小VCO中两个可变电容两端的电压受LDO输出电压波动的影响,减小VCO输出pushing;

2)在PLL环路中加一个用运算放大器结成的跟随电路,使控制电压Vtune首先通过运算放大器构成的跟随后再接到VCO作为控制电压,电路结构简单且实现方便;

3)电路设计及制造成本低,进一步保障了产品市场竞争力。

附图说明

图1为本实用新型应用到频率合成器环路中的结构示意图;

图2为本实用新型电路结构示意图;

图中,1-稳压源,2-跟随电路,3-压控振荡器,4-运算放大器,5-电源端,6-同相输入端,7-反相输入端,8-输出端,9-控制电压端。

具体实施方式

下面结合附图进一步详细描述本实用新型的技术方案,但本实用新型的保护范围不局限于以下所述。

如图1所示,在PLL锁相环中加一个用运算放大器4接成的跟随电路,PLL锁相环由鉴相器PFD_CP、二阶滤波器、运算放大器4、压控振荡器VCO3和N分频器组成,鉴相器PFD_CP的一个输入端连接基准电源Vref,鉴相器PFD_CP的输出端通过二阶滤波器与运算放大器4的同相输入端6连接,运算放大器4的反相输入端7与运算放大器4的输出端8相连接,运算放大器4的输出端8与压控振荡器VCO3连接,压控振荡器VCO3的频率输出与N分频器的输入连接,N分频器的输出与鉴相器PFD_CP的另一个输入端相连。

如图2所示,一种可有效减小压控振荡器输出频率变化的电路,它包括稳压源LDO1、跟随电路2和压控振荡器VCO3,跟随电路2由运算放大器4组成;稳压源LDO1的一路输出与压控振荡器VCO3的电源端5连接,稳压源LDO1的另一路输出与运算放大器4的正电源端相连;运算放大器4的同相输入端6连接控制电压Vtune,运算放大器4的反相输入端7与运算放大器4的输出端8相连接,运算放大器4的输出端8与压控振荡器VCO3的控制电压端9连接。稳压源LDO1、压控振荡器VCO3及运算放大器4共地。

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