[发明专利]一种负压电平转换控制电路和方法有效

专利信息
申请号: 202010970861.8 申请日: 2020-09-15
公开(公告)号: CN112202440B 公开(公告)日: 2022-08-09
发明(设计)人: 刘炽锋;张鑫 申请(专利权)人: 广州慧智微电子股份有限公司
主分类号: H03K19/017 分类号: H03K19/017;H03K19/0185
代理公司: 北京派特恩知识产权代理有限公司 11270 代理人: 贾伟;张颖玲
地址: 510663 广东省广州市*** 国省代码: 广东;44
权利要求书: 查看更多 说明书: 查看更多
摘要: 发明提供了一种负压电平转换控制电路和方法,所述负压电平转换控制电路包括:负压产生电路、偏置电路和电平移位单元电路;其中,所述偏置电路的输出端与所述电平移位单元电路连接,另一端与所述负压产生电路连接;所述负压产生电路的输出端与所述电平移位单元电路连接;所述偏置电路用于接收使能信号,输出偏置电压;所述偏置电压用于控制所述电平移位单元电路的切换过程;所述使能信号用于对所述偏置电路和所述负压产生电路使能。
搜索关键词: 一种 压电 转换 控制电路 方法
【主权项】:
暂无信息
下载完整专利技术内容需要扣除积分,VIP会员可以免费下载。

该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于广州慧智微电子股份有限公司,未经广州慧智微电子股份有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服

本文链接:http://www.vipzhuanli.com/patent/202010970861.8/,转载请声明来源钻瓜专利网。

同类专利
  • 一种宽范围高速双输出电平移位电路-202310762526.2
  • 岳宏卫;韦家锐;韦善于;许仕海 - 桂林电子科技大学
  • 2023-06-27 - 2023-08-22 - H03K19/017
  • 本发明公开了一种宽范围高速双输出电平移位电路,属于模拟集成电路技术领域。本发明提出的宽范围高速双输出电平移位电路,NOMS管MN1和NOMS管MN2使用低电压阈值类型的管子,从而较低的输入信号也能使电路开启。另外还引入了瞬态增强结构和正反馈结构,由NMOS管MN3和NMOS管MN4构成的两个瞬态增强结构,在输入电平跳变时实现快速转换,并且在电路稳定之后关闭。由PMOS管MP1和PMOS管MP2构成的正反馈结构,加快了输入电平到输出电平的转换速度。接在NMOS管MN1漏极和NMOS管MN2漏极之间的反相器B进一步加快了MD2节点到达高电平的稳态速度。电阻R1和PMOS管MP3组成的通路能将MD2节点的电平快速拉高,电阻R2和PMOS管MP4组成的通路能将MD1节点的电平快速拉高。NMOS管MN5导通时可以将MD2节点的电平快速拉低。因此,本发明不仅具有宽输入范围和输出快速转换的优势,而且还能同时输出逻辑相反的两个信号。
  • 一种提升复位速度的积分器电路-202110141961.4
  • 王海强;王洪波;曹海祥 - 同源微(北京)半导体技术有限公司
  • 2021-02-02 - 2023-08-18 - H03K19/017
  • 本发明的一个实施例公开了一种提升复位速度的积分器电路,电路包括:放大器,包括反向输入端、正向输入端、输出端和复位端;积分电容阵列;第一开关;和第二开关;积分电容阵列的第一端、第一开关的第一端和第二开关的第二端连接反向输入端;积分电容阵列的第二端和第一开关的第二端连接输出端;第二开关的第一端接收电流输入信号;正向输入端接收参考电压;在粗复位阶段,第一开关接收有效的第一复位信号,复位端接收有效的第二复位信号,使得输出端输出的电压输出信号接近参考电压;在精复位阶段,第一开关继续接收有效的第一复位信号,复位端不再接收有效的第二复位信号,使得输出端输出的电压输出信号相较于粗复位阶段更接近参考电压。
  • 半导体装置-201710824613.0
  • 田边昭 - 瑞萨电子株式会社
  • 2017-09-14 - 2023-07-25 - H03K19/017
  • 本公开涉及半导体装置。现有技术的反向偏置生成电路由于驱动功率降低以降低待机状态下的功耗而导致在操作状态和待机状态之间转变需要较长时间的问题。反向偏置生成电路输出预定电压。预定电压是待机模式下的衬底的反向偏置电压。偏置控制电路当电路块处于操作模式时存储电荷,当电路块从操作模式转变到待机模式时,将所存储的电荷供应给包括在电路块中的MOSFET的衬底,随后将反向偏置生成电路的输出供应给MOSFET的衬底。
  • 供功率转换应用的高速电平转换器-202280005210.2
  • 陈捷生;钱为;高子阳 - 香港应用科技研究院有限公司
  • 2022-12-22 - 2023-07-07 - H03K19/017
  • 电平转换电路使用标准的n沟道和p沟道晶体管,除了一对横向扩散金属氧化物半导体(LDMOS)晶体管(40,42)外,其在源极和传导沟道之间的栅极之下具有增加的横向扩散,从而增加了击穿电压。每个LDMOS晶体管(40,42)的源极连接到一个瞬态差分晶体管(70,72)的漏极,此晶体管的栅极由一个在输入转换后产生脉冲的单稳态电路(62,64)驱动。脉冲结束后,保持差分晶体管(50,52)从LDMOS晶体管(40,42)汲取较小的偏置电流。每个LDMOS晶体管(40,42)的源极连接到p沟道感测晶体管(20,30)的漏极和栅极,p沟道感测晶体管(20,30)驱动镜像晶体管(22,24,32,34)的栅极,以产生镜像电流到交叉耦合n沟道镜像晶体管(28,36),n沟道镜像晶体管(28,36)驱动双稳态锁存器(60)的两个终端,且双稳态锁存器(60)使用由双稳态锁存器(60)切换的降压转换器的驱动器晶体管之间的浮置接地来保持输出。
  • 一种高速无静态功耗的电平位移电路-202210380261.5
  • 周泽坤;彭栎郴;龚州;王卓;张波 - 电子科技大学
  • 2022-04-12 - 2023-05-05 - H03K19/017
  • 本发明属于模拟集成电路技术领域,具体涉及一种高速无静态功耗的电平位移电路。本发明提出的高速无静态功耗的电平位移电路,采用电容耦合的方式,实现了电平信号从低电源轨到高侧电源轨的快速切换,因此该电路可以广泛应用于低功耗,高速的应用场景。本发明的有益效果为,减小了传统电平位移打破锁存稳态所需的电流大小,从而减小动态功耗并实现快速的逻辑翻转。
  • 一种基于摆幅恢复传输管逻辑的全加器-201911171039.9
  • 张跃军;韩金亮;吴志信;张会红 - 宁波大学
  • 2019-11-26 - 2023-04-25 - H03K19/017
  • 本发明公开了一种基于摆幅恢复传输管逻辑的全加器,包括异或/同或电路、两个数据选择器和三个反相器,异或/同或电路包括第一MOS管、第二MOS管、第三MOS管、第四MOS管、第五MOS管、第六MOS管、第七MOS管、第八MOS管、第九MOS管和第十MOS管,第一数据选择器包括第十一MOS管、第十二MOS管、第十三MOS管、第十四MOS管、第十五MOS管、第十六MOS管、第十七MOS管、第十八MOS管、第十九MOS管和第二十MOS管,第二数据选择器包括第二十一MOS管、第二十二MOS管、第二十三MOS管、第二十四MOS管和第四反相器;优点是低电压时输出可以达到全摆幅,驱动能力强,能够用于低电压环境。
  • 用于高阻抗输入的低功率有源偏置电路-201880012132.2
  • N·P·德洛尔姆;C·勒布朗;D·萨亚斯 - 斯普林格斯公司
  • 2018-01-11 - 2023-04-18 - H03K19/017
  • 本发明涉及一种用于检测节点的悬置状态的电路,所述电路包括连接在节点(N)与第一电源线(Vss)之间的具有第一导电类型的第一MOS晶体管(M1);以及与第一导电类型互补的导电类型的第二MOS晶体管(M2),其由节点(N)控制并连接在第一晶体管(M1)的栅极与第二电源线(Vdd)之间。附加地,所述电路包括具有第一导电类型的第三MOS晶体管(M3),所述第三MOS晶体管(M3)连接在第一晶体管(M1)的栅极与第一电源线(Vss)之间并可以由节点(N)控制。
  • 一种超低功耗高速动态锁存比较器-202211576147.6
  • 陈腾腾;许正杰;聂建波;王阿明 - 南京模砾半导体有限责任公司
  • 2022-12-09 - 2023-01-31 - H03K19/017
  • 本发明公开了一种超低功耗高速动态锁存比较器,所述比较器由一对交叉耦合的反相器、cascode电流镜和两个电流源型反相器构成。通过将mos管由栅极输入改成由衬底输入,输入对的体跨导和交叉耦合的反相器的总跨导将提供更强的正反馈,极大的减小比较器的延迟;两个电流源型反相器,进一步减小了比较器的延迟;此外,采用cascode技术抑制了沟长调制系数,所以当输入共模电压变化时,降低了动态失调电压,抑制了电源功耗,限制了比较器延迟随共模电压的变化。与传统结构相比,去掉了预放大级,极大的降低了电路复杂度,解决了多级级联功耗大、实际测试翻转速度慢、消耗资源多等问题。
  • 基于低功率反相器的CTLE-202080096772.3
  • J·卓;K·郑;P·乌帕德亚雅 - 赛灵思公司
  • 2020-12-28 - 2022-10-14 - H03K19/017
  • 提供了包括连续时间线性均衡器CTLE的电子器件。连续时间线性均衡器CTLE的一个例子包括第一反相器(402);第二反相器(404),具有接收输入信号的输入端(IN);电容器(408),被耦接在第一反相器(402)的输入端和第二反相器(404)的输入端之间;电阻器(410),被耦接在共模电压(VCM)与第一反相器的输入端之间;第三反相器(406),具有输出端,以提供输出信号(Out);以及节点(416),包括第一反相器(404)的输出端、第二反相器(402)的输出端、第三反相器(406)的输入端、和第三反相器的输出端。
  • 用于启用和禁用输出驱动器电路中的晶体管腿的技术-201780017683.3
  • 陈达兴;何月松;黄忠杰 - 阿尔特拉公司
  • 2017-02-15 - 2022-10-14 - H03K19/017
  • 输出驱动器电路包含控制电路以及耦合到输出衬垫的第一和第二晶体管腿。第一和第二晶体管腿中的每个都包含上拉晶体管和下拉晶体管。控制电路耦合到第一和第二晶体管腿。控制电路在循环的第一阶段期间启用第一晶体管腿以在输出衬垫生成输出信号,并且禁用第二晶体管腿。控制电路在循环的第二阶段期间启用第二晶体管腿以在输出衬垫生成输出信号,并且禁用第一晶体管腿。控制电路重复循环的第一和第二阶段。
  • 一种基于C单元的三节点翻转自恢复锁存器-202011112147.1
  • 闫爱斌;钱奎奎;许哲龙;崔杰;倪天明;宋钛;黄正峰 - 安徽大学
  • 2020-10-16 - 2022-10-14 - H03K19/017
  • 本发明涉及一种基于C单元的三节点翻转自恢复锁存器,包括矩阵存储模块和八个传输门;所述矩阵存储模块由十六个二输入C单元组成,所述八个传输门包括第一传输门TG1、第二传输门TG2、第三传输门TG3、第四传输门TG4、第五传输门TG5、第六传输门TG6、第七传输门TG7和第八传输门TG8;所述第一传输门TG1、第二传输门TG2、第三传输门TG3、第四传输门TG4的信号输入端均作为锁存器的数据输入端D,所述第四C单元CE4的第一信号输入端作为锁存器的数据输出端。本发明提高了锁存器电路的可靠性;在锁存器输入端和输出端要求具有同向逻辑值的情况下,本发明提供的锁存器未增加面积开销。此外,由于在透明模式下,输入端和输出端仅存在一个传输门,传播延迟大大降低。
  • 一种PWM逻辑电平转换电路-202221192214.X
  • 李华 - 深圳市能效电气技术有限公司
  • 2022-05-17 - 2022-08-26 - H03K19/017
  • 本实用新型公开了一种PWM逻辑电平转换电路,包括PWM信号输入端、PWM信号输出端、NPN三极管、第一电阻、第二电阻、第三电阻、第四电阻和第五电阻,NPN三极管的集电极接PWM信号输出端,并通过第五电阻接第一直流电源正极;NPN三极管的发射极接PWM信号输入端,并通过第三电阻接NPN三极管的基极;NPN三极管的基极接第一电阻的第一端,第一电阻的第二端接第二直流电源正极;第一电阻的第一端通过第二电阻接电源地,PWM信号输入端通过第四电阻接电源地;第一直流电源正极的电压高于PWM信号输入端PWM信号高电平的电压。本实用新型可以将低电压的PWM信号转换成高电压的的PWM信号,提高PWM信号的抗干扰能力。
  • 一种基于NMOS管控制的正端开关控制器-202221039192.3
  • 张邦全;古志中;敬攀;陈曦 - 重庆力华自动化技术有限责任公司
  • 2022-04-29 - 2022-08-23 - H03K19/017
  • 本实用新型提供一种基于NMOS管控制的正端开关控制器,包括供电电源、独立电源、控制开关信号输入装置、开关控制电路、NMOS管驱动电路、NMOS管和用电负载,供电电源正极经接线端子J6与NMOS管漏极连接,独立电源正极与NMOS管驱动电路的输入端连接,控制开关信号输入装置经开关控制电路与NMOS管驱动电路控制端连接,NMOS管驱动电路输出端与NMOS管栅极连接,NMOS管源极与接线端子J7的一端和地GND2连接,接线端子J7另一端与独立电源负极和用电负载一端连接,用电负载另一端与供电电源负极和地GND1连接,地GND1和地GND2为共地连接。本开关控制器成本低,无活动部件,抗震动强,开关速度快,动作安静,无触点,无火花可适应危险油气环境工作,从而能够适应更多工作环境和需求。
  • 一种负压电平转换控制电路和方法-202010970861.8
  • 刘炽锋;张鑫 - 广州慧智微电子股份有限公司
  • 2020-09-15 - 2022-08-09 - H03K19/017
  • 本发明提供了一种负压电平转换控制电路和方法,所述负压电平转换控制电路包括:负压产生电路、偏置电路和电平移位单元电路;其中,所述偏置电路的输出端与所述电平移位单元电路连接,另一端与所述负压产生电路连接;所述负压产生电路的输出端与所述电平移位单元电路连接;所述偏置电路用于接收使能信号,输出偏置电压;所述偏置电压用于控制所述电平移位单元电路的切换过程;所述使能信号用于对所述偏置电路和所述负压产生电路使能。
  • 实现NAND门系统和实现NOR门系统的集成电路-202110419241.X
  • 奥古斯丁·魏-春·张;皮埃尔·德尔米 - 肖特基LSI公司
  • 2018-04-10 - 2022-07-08 - H03K19/017
  • 本发明涉及实现NAND门系统和实现NOR门系统的集成电路。一种实现NAND门系统的集成电路,包括:第一输入,其耦合到第一肖特基二极管的阴极;x个附加输入,其耦合到x个附加肖特基二极管的x个相应的阴极,其中,x是整数;逆变器,其具有逆变器输入和逆变器输出,其中:集成电路被配置用于异步操作;逆变器在高压电源和低压电源之间被偏置;逆变器输入耦合到第一肖特基二极管的阳极和x个附加肖特基二极管的x个相应的阳极;并且逆变器输出耦合到NAND门系统的输出;以及源极跟随器树,其包括一个或多个N型晶体管,其中,源极跟随器树在高压电源和逆变器输入之间被偏置。
  • 电压生成电路及半导体模块-202111509870.8
  • 松下也实 - 三菱电机株式会社
  • 2021-12-10 - 2022-07-01 - H03K19/017
  • 本发明涉及电压生成电路及半导体模块。提供将适当的控制电源电压施加于高电位侧驱动电路而改善高电位侧开关元件的特性的电压生成电路。电压生成电路包含自举电路和降压电路。自举电路包含二极管和电流限制电阻。降压电路与高电位侧开关元件的高电位侧和自举电路的输入侧连接。降压电路将对施加于高电位侧开关元件的高电位侧的电源电压进行降压而生成的已补偿电源电压输出至自举电路。降压电路生成向低电位侧驱动电路用控制电源电压加上与由二极管和电流限制电阻引起的电压降对应的补偿电压后的已补偿电源电压。
  • 电路及电子设备-202121486818.0
  • M·G·丰塔纳;M·里瓦;F·普尔维伦蒂;G·坎通 - 意法半导体股份有限公司
  • 2021-07-01 - 2022-06-03 - H03K19/017
  • 本实用新型公开了电路及电子设备。电路包括第一、第二输入电源节点,第一、第二输入电源节点接收其间的电源电压。该电路包括高侧驱动器电路,耦合到高侧开关且在第一、第二高侧输出节点之间产生第一信号。该电路包括低侧驱动器电路,耦合到低侧开关,且在第一、第二低侧输出节点之间产生第二信号。该电路包括:浮置节点,接收施加在浮置节点和第二高侧输出节点之间的浮置电压;自举二极管,位于第一输入电源节点和中间节点之间;限流器电路,位于中间节点和浮置节点之间,感测浮置电压,且由于浮置电压达到阈值而抵消从中间节点流向浮置节点的电流。本实用新型的技术提供了具有改进的效率和/或鲁棒性的驱动器电路和电子设备。
  • 一种混合型CMOS-忆阻全加器电路-202110456022.9
  • 林弥;王旭亮;陈俊杰;韩琪;罗文瑶 - 杭州电子科技大学
  • 2021-04-26 - 2022-05-17 - H03K19/017
  • 本发明公开了一种混合型CMOS‑忆阻全加器电路,包括第一阈值型忆阻器M1、第二阈值型忆阻器M2、第三阈值型忆阻器M3,第一NMOS晶体管NM1、第二NMOS晶体管NM2、第三NMOS晶体管NM3、第四NMOS晶体管NM4、第五NMOS晶体管NM5、第六NMOS晶体管NM6、第七NMOS晶体管NM7、第八NMOS晶体管NM8,第一PMOS晶体管PM1、第二PMOS晶体管PM2、第三PMOS晶体管PM3、第四PMOS晶体管PM4、第五PMOS晶体管PM5。该电路通过调节忆阻器阻态、CMOS管的导通和截止来实现全加运算的功能,电路结构简单,对忆阻数字逻辑电路的研究具有重大意义。
  • 一种高速低功耗电位平移电路-202210099785.7
  • 闸钢 - 深圳能芯半导体有限公司
  • 2022-01-27 - 2022-05-13 - H03K19/017
  • 本申请涉及一种高速低功耗电位平移电路,涉及功率开关控制的技术领域,包括电流比较器模块、偏置模块、动态电流产生模块、第一反相器IV1、第一电源端VCC、信号输入端IN以及信号输出端OUT;电流比较器模块的输入端连接于第一反相器和信号输入端IN,电流比较器模块的输出端连接于信号输出端OUT,电流比较器模块的电源端连接于第一电源端VCC,电流比较器模块还连接于偏置模块和动态电流产生模块,动态电流产生模块的输入端连接于信号输入端IN和第一反相器IV1,偏置模块用于提供偏置电流;动态电流产生模块用于在输入信号发生变化时为电位平移电路提供额外的瞬时动态电流。本申请具有提高电位平移的转换速度以及减少静态功耗的效果。
  • 电平转换电路-202011114764.5
  • 杨丽婷;倪昊;刘晓艳 - 中芯国际集成电路制造(北京)有限公司;中芯国际集成电路制造(上海)有限公司
  • 2020-10-16 - 2022-04-22 - H03K19/017
  • 一种电平转换电路。所述电平转换电路包括:输入子电路、隔离子电路及输出子电路;其中,所述输入子电路包括:第一NMOS管、第二NMOS管、反相器;所述输出子电路包括:第一PMOS管及第二PMOS管;所述第一NMOS管及第二NMOS管,源极接地,漏极与所述隔离子电路连接;所述隔离子电路与所述第一PMOS管及第二PMOS管的漏极连接;所述第一NMOS管及第二NMOS管的阈值电压,小于所述第一PMOS管及第二PMOS管的阈值电压;所述隔离子电路,用于连通所述输入子电路及输出子电路,并为所述第一NMOS管及第二NMOS管提供相适应的漏极电压。应用上述方案,可以提高电平转换电路的电平转换速度。
  • 一种高速接收电路及其运行方法-202011096185.2
  • 许振隆 - 尼奥耐克索斯有限私人贸易公司
  • 2020-10-14 - 2022-04-15 - H03K19/017
  • 本发明涉及一种高速接收电路,包括:第一nMOSFET(MN1)、第二nMOSFET(MN2)、第一pMOSFET(MP1)、以及第二pMOSFET(MP2)。该高速接收电路还包括第三nMOSFET(MN3)和第四nMOSFET(MN4)。本发明还涉及一种用于运行这样的电路的方法。通过根据本发明的高速接收电路和/或方法,可以显著降低高速接收器的延迟并且同时扩展其高速稳定工作的输入电压范围。
  • 存储系统-202010766451.1
  • 寗树梁 - 长鑫存储技术有限公司
  • 2020-08-03 - 2022-02-18 - H03K19/017
  • 本发明提供一种存储系统,其包括数据端口,所述数据端口包括数据输出单元,所述数据输出单元包括:上拉单元,具有控制端、第一端及第二端,第一输入信号输入至所述控制端,所述第一端与电源电连接,所述第二端连接所述数据输出单元的输出端,所述上拉单元为第一NMOS管;下拉单元,具有控制端、第一端及第二端,第二输入信号输入至所述控制端,所述第一端与接地端电连接,所述第二端连接所述数据输出单元的输出端。本发明的优点在于,设置上拉单元及下拉单元,其中,所述上拉单元为NMOS管,能够有效加快数据输出单元电压由低到高或由高到低的速度,即减小数据输出单元电压由低到高或由高到低的转变时间,提升了数据传输速度,提高了存储系统的性能。
  • 驱动器电路、对应的设备及操作方法-202110745747.X
  • M·G·丰塔纳;M·里瓦;F·普尔维伦蒂;G·坎通 - 意法半导体股份有限公司
  • 2021-07-01 - 2022-01-04 - H03K19/017
  • 公开了驱动器电路、对应的设备及操作方法。电路,包括第一、第二输入电源节点,第一、第二输入电源节点接收其间的电源电压。该电路包括高侧驱动器电路,高侧驱动器电路耦合到高侧开关且在第一高侧输出节点和第二高侧输出节点之间产生第一信号。该电路包括低侧驱动器电路,低侧驱动器电路耦合到低侧开关,并且在第一低侧输出节点和第二低侧输出节点之间产生第二信号。该电路包括:浮置节点,接收施加在浮置节点和第二高侧输出节点之间的浮置电压;自举二极管,位于第一输入电源节点和中间节点之间;以及限流器电路,位于中间节点和浮置节点之间,感测浮置电压,并且由于浮置电压达到阈值而抵消从中间节点流向浮置节点的电流。
  • 一种亚阈值电路的优化方法及系统-201710308228.0
  • 陈岚;吴玉平;孙旭 - 中国科学院微电子研究所
  • 2017-05-04 - 2022-01-04 - H03K19/017
  • 本发明实施例公开了一种亚阈值电路的优化方法,包括:从亚阈值逻辑门网表中确定D触发器;确定与所述D触发器的输入端连接的组合逻辑电路;在所述组合逻辑电路与所述D触发器之间插入可变阈值反相器,以获得优化后的亚阈值逻辑门网表,其中,所述组合逻辑电路的输出端连接所述可变阈值反相器的输入端,所述可变阈值反相器的输出端连接所述D触发器的数据输入端,所述D触发器的数据输出端连接所述可变阈值反相器的控制端。本发明加速D触发器从一个状态向另一个状态的跳变,实现在相同的工作电压下提高电路的工作速度的目的。
  • 信号电平转换电路-202022938683.9
  • 徐万芝;何俐鹏;王敏 - 深圳微慕科技有限公司
  • 2020-12-10 - 2021-10-01 - H03K19/017
  • 本实用新型公开了一种信号电平转换电路,包括三极管Q1、第一电源和第二电源,三极管Q1的基极通过电阻R1连接至第二电源的供电端,三极管Q1的基极与发射极之间连接有电阻R2,三极管Q1的集电极通过电阻R3连接至第一电源的供电端,第一电源的供电电压高于第二电源的供电电压,三极管Q1的集电极为信号输入端,三极管Q1的发射极为信号输出端。本实用新型设计思路简单实用,不使用芯片方案,成本低,有利于产品的成本管控;电平转换所需要的器件相对较少,利于PCB布局走线;可适用多种通讯应用环境,频率响应速度快。
  • 一种超低功耗的高速度动态电平转换器-201911401647.4
  • 张长洪 - 圣邦微电子(北京)股份有限公司
  • 2019-12-31 - 2021-07-16 - H03K19/017
  • 本发明所述的一种超低功耗的高速度动态电平转换器,包括上升沿延时控制级电路和输出驱动级电路,所述上升沿延时控制级电路控制所述输出驱动级电路的第一PMOS开关管和第二PMOS开关管的启闭,以确保输出电平信号能够正常开启或关闭第一负载PMOS开关管,所述输出驱动级电路利用电荷在第二电容、第一PMOS开关管的栅源电容、第一负载PMOS开关管的栅源电容与工作电压之间的相互转移来实现输入电平信号到输出电平信号之间的电平转换,几乎没有电荷的流失,实现了工作电压的超低功率损耗运行,而且该超低功率损耗与工作电压的电位高低、输入电平信号的频率快慢没有关系,输入电平信号到输出电平信号的传输速度非常快。
  • 接口电路和接口装置-202011332737.5
  • 朴钟旻 - 三星电子株式会社
  • 2020-11-24 - 2021-07-06 - H03K19/017
  • 接口装置,其包括多个接口电路,其中,多个接口电路中的每个接口电路包括串联连接到第二开关元件的第一开关元件、以及连接到输出端子的第一电容器和第二电容器,第一开关元件和第二开关元件连接到该输出端子;以及控制器,其被配置为通过控制第一开关元件和第二开关元件来确定与多个接口电路相对应的多个输出信号,并且被配置为通过对第一电容器和第二电容器进行充电和放电来调节多个输出信号的转换速率。
  • 一种DDR发送电路-202110059798.7
  • 孔亮;陈捷;刘亚东;庄志青 - 灿芯半导体(上海)有限公司
  • 2021-01-18 - 2021-02-19 - H03K19/017
  • 本发明公开了一种DDR发送电路,包括:第一PMOS管、第二PMOS管、第一NMOS管、第二NMOS管、电阻、同相器、反相器以及用于提供第一电压信号至第三电压信号之间电压的低压器件,所述第一PMOS管的源极接第三电压信号,栅极接所述低压器件的输出端,漏极连接所述第二PMOS管的源极;所述低压器件的三个输入端分别连接所述同相器的输出端、所述第一电压信号和所述第三电压信号;所述同相器的输入端接电平信号;所述第一NMOS管的源极接地,栅极接所述反相器的输出端,漏极接所述第二NMOS管的源极;反相器的输入端接电平信号;第二PMOS管的漏极和第二NMOS管的漏极相接并连接电阻的第一端。采用速度较快的低压器件做主驱动电路及前驱动电路,有效提高工作速度。
专利分类
×

专利文献下载

说明:

1、专利原文基于中国国家知识产权局专利说明书;

2、支持发明专利 、实用新型专利、外观设计专利(升级中);

3、专利数据每周两次同步更新,支持Adobe PDF格式;

4、内容包括专利技术的结构示意图流程工艺图技术构造图

5、已全新升级为极速版,下载速度显著提升!欢迎使用!

请您登陆后,进行下载,点击【登陆】 【注册】

关于我们 寻求报道 投稿须知 广告合作 版权声明 网站地图 友情链接 企业标识 联系我们

钻瓜专利网在线咨询

400-8765-105周一至周五 9:00-18:00

咨询在线客服咨询在线客服
tel code back_top