[发明专利]用于多晶片图像传感器的DRAM和逻辑单元之间的可配置接口对准缓冲器有效

专利信息
申请号: 202010032920.7 申请日: 2020-01-13
公开(公告)号: CN111435977B 公开(公告)日: 2021-09-17
发明(设计)人: 秦晴;柳勋;丁台衡 申请(专利权)人: 豪威科技股份有限公司
主分类号: H04N5/378 分类号: H04N5/378
代理公司: 北京清亦华知识产权代理事务所(普通合伙) 11201 代理人: 宋融冰
地址: 美国加利*** 国省代码: 暂无信息
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摘要: 图像传感器具有被配置在多个块中的像素的阵列;每个块耦合到单独的模数转换器(ADC),以提供数字化的图像数据。ADC将数字化的图像馈送到图像RAM中;并且图像RAM以第一像素次序将数字化的图像馈送到对准缓冲器。对准缓冲器以不同于第一像素次序的第二像素次序将数字化的图像提供给图像处理器。在实施例中,对准缓冲器使用多端口RAM。在另一个实施例中,对准缓冲器使用第一对准缓冲器RAM和第二对准缓冲器RAM,在读取另一个对准缓冲器RAM的同时写入一个对准缓冲器RAM以将图像数据提供给图像处理器。在实施例中,对准缓冲器以在全分辨率和降低分辨率次序之间可选择以及在从右到左和从左到右次序之间可选择的次序来提供数字化的图像。
搜索关键词: 用于 多晶 图像传感器 dram 逻辑 单元 之间 配置 接口 对准 缓冲器
【主权项】:
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  • 郭仲杰;程新齐;许睿明;刘绥阳;王彬;余宁梅 - 西安理工大学
  • 2022-06-29 - 2022-09-27 - H04N5/378
  • 本发明公开了一种大阵列CMOS图像传感器双侧均衡驱动方法,包括时序控制模块、长距离传输线I、长距离传输线II、逻辑运算电路、计数器、延迟电路。时序控制模块的输出接延迟电路的输入、逻辑运算电路的输入端A和长距离传输线I,长距离传输线I接右侧行驱动模块的输入和长距离传输线II,长距离传输线II接逻辑运算电路的B输入,逻辑运算电路的输出C控制计数器的工作,计数器的输出接延迟电路的配置端,延迟电路的输出接左侧的行驱动模块。本发明可对由于延迟时间差导致的信号不同步的现象进行矫正,从而提高CMOS图像传感器的驱动均衡性,改善成像质量。
  • 数字相关双采样电路和包括其的图像传感器-201811118548.0
  • 李赫钟 - 三星电子株式会社
  • 2018-09-25 - 2022-09-27 - H04N5/378
  • 本申请提供了一种数字相关双采样(CDS)电路和一种图像传感器。该数字相关双采样电路包括第一锁存电路、第一转换电路、第二转换电路、第二锁存电路和计算电路。第一锁存电路基于第一控制信号锁存输入相移码,以存储第一相移码和第二相移码。第一转换电路将第一相移码和第二相移码转换为第一格雷码和第二格雷码。第二转换电路将第一格雷码和第二格雷码转换为第一二进制码和第二二进制码。第二锁存电路基于第二控制信号锁存第二转换电路的输出,以存储第一二进制码。计算电路对第一二进制码和第二二进制码操作,以产生第三二进制码,并且输出第三二进制码。
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