[发明专利]一种基于DDR读数据整数时钟周期的同步电路及同步方法有效
| 申请号： | 201911375233.9 | 申请日： | 2019-12-27 |
| 公开（公告）号： | CN111208867B | 公开（公告）日： | 2021-08-24 |
| 发明（设计）人： | 王亮;吴汉明 | 申请（专利权）人： | 芯创智（北京）微电子有限公司 |
| 主分类号： | G06F1/12 | 分类号： | G06F1/12 |
| 代理公司： | 北京天悦专利代理事务所(普通合伙) 11311 | 代理人： | 任晓航;杨方 |
| 地址： | 100176 北京市大兴区北京经济*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种基于DDR读数据整数时钟周期的同步电路及同步方法，同步电路包括：相互连接的物理层校准电路和读数据有效使能生成电路；物理层校准电路用于对DDR读数据与参考数据进行延迟多拍使能比较，得到比较结果；读数据有效使能生成电路用于根据比较结果确定DDR读数据到达DDR物理层的整数时钟周期，将DDR读数据的有效使能延迟确定的整数时钟周期，实现DDR读数据整数时钟周期同步。本发明采用延迟多拍使能比较信号的方式确定DDR读数据到达DDR物理层的整数时钟周期，把该数据有效使能延迟相应的整数时钟周期，实现DDR读数据整数时钟周期同步。 | ||
| 搜索关键词： | 一种 基于 ddr 读数 整数 时钟 周期 同步 电路 方法 | ||
【主权项】：
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