[发明专利]低时钟电源电压可中断定序电路在审

专利信息
申请号: 201780048490.4 申请日: 2017-07-13
公开(公告)号: CN109565270A 公开(公告)日: 2019-04-02
发明(设计)人: A·阿加瓦尔;S·K·徐;R·K·克里希纳穆希 申请(专利权)人: 英特尔公司
主分类号: H03K3/3562 分类号: H03K3/3562;H03K3/037
代理公司: 上海专利商标事务所有限公司 31100 代理人: 黄嵩泉;钱慰民
地址: 美国加利*** 国省代码: 美国;US
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摘要: 提供一种设备,该设备包括:时钟反相器,该时钟反相器具有耦合到时钟节点的输入,该时钟反相器具有输出,其中该时钟反相器具有耦合到第一电源的N阱;以及多个定序逻辑,该多个定序逻辑耦合到时钟反相器的输出并且还耦合到时钟节点,其中多个定序逻辑的至少一个定序逻辑具有耦合到第二电源的N阱,其中,第二电源具有比第一电源的电压电平低的电压电平。
搜索关键词: 时钟反相器 耦合到 定序逻辑 电源 电压电平 时钟节点 输出 电路提供 电源电压 低时钟
【主权项】:
1.一种设备,包括:时钟节点,所述时钟节点用于提供使用第一电源生成的时钟信号;数据节点,所述数据节点用于提供使用第二电源生成的数据信号,其中所述第一电源具有比所述第二电源的电压电平低的电压电平;数据反相器,所述数据反相器耦合到所述数据节点;第一反相器,所述第一反相器具有第一时钟可中断p型设备和第一数据输入p型设备,所述第一时钟可中断p型设备耦合到所述时钟节点,所述第一数据输入p型设备耦合到所述数据节点;以及第二反相器,所述第二反相器具有耦合到所述第一反相器的输入的输出,以及耦合到所述第一反相器的输出的输入,其中所述第二反相器包括第二时钟可中断p型设备和第二数据输入p型设备,所述第二时钟可中断p型设备耦合到所述时钟节点,所述第二数据输入p型设备耦合到所述数据反相器。
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