[实用新型]一种模拟加速器调控系统的实验装置有效
| 申请号： | 201721265614.8 | 申请日： | 2017-09-29 |
| 公开（公告）号： | CN207301727U | 公开（公告）日： | 2018-05-01 |
| 发明（设计）人： | 张鹏蛟;陈希;周博文;柯宜金;张文涛;赵鹏 | 申请（专利权）人： | 安德信微波设备有限公司 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042 |
| 代理公司： | 常州佰业腾飞专利代理事务所(普通合伙)32231 | 代理人： | 刘娟娟 |
| 地址： | 210000 江苏省南京市栖*** | 国省代码： | 江苏;32 |
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| 摘要： | 本实用新型涉及一种模拟加速器调控系统的实验装置。本实用新型用于解决现有技术中加速器不可替代的问题。它通过低电平控制器和外围电路控制带通滤波器，模拟加速器调控系统，在没有加速器的实验条件下，测试低电平调控系统的性能。该实验方法简单，降低了投入的人力和物力。保证调控系统的可靠性和快速性。因此，本实用新型可以广泛用于加速器调试技术领域。 | ||
| 搜索关键词： | 一种 模拟 加速器 调控 系统 实验 装置 | ||
【主权项】：
一种模拟加速器调控系统的实验装置，其特征在于：它包括信号功率源发生器(10)、低电平控制器(20)和上位机(30)；所述低电平控制器(20)分别连接所述信号功率源发生器(10)和所述上位机(30)；其中，所述低电平控制器(20)包括第一功率计(201)、功分器(202)、本征信号发生器(203)、时钟分配器(204)、FPGA(205)、DAC(206)、第一ADC(207)、第二ADC(208)、第三ADC(209)、第一混频器(210)、第二混频器(211)、第三混频器(212)和第四混频器(213)；所述第一功率计(201)的入口连接所述信号功率源发生器(10)，所述第一功率计(201)的出口连接所述功分器(202)，所述功分器(202)的出口分别连接所述本征信号发生器(203)和所述时钟分配器(204)，且所述本征信号发生器(203)和所述时钟分配器(204)分别连接所述FPGA(205)；所述FPGA(205)依次连接所述DAC(206)、所述第四混频器(213)、速调管(40)、环路器(50)、定向耦合器(60)的入口和带通滤波器(70)的入口；所述定向耦合器(60)的第一出口依次连接所述第一混频器(210)、所述第一ADC(207)和所述FPGA(205)；所述定向耦合器(60)的第二出口依次连接所述第二混频器(211)、所述第二ADC(208)和所述FPGA(205)；所述带通滤波器(70)的出口依次连接第二功率计(80)、所述第三混频器(212)、所述第三ADC(209)和所述FPGA(205)；所述FPGA(205)还依次连接步进电机驱动器(90)和步进电机(100)；所述FPGA(205)还连接所述上位机(30)。
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