[发明专利]一种数模转换器的内部时钟时序矫正控制系统

摘要

本发明涉及一种数模转换器的内部时钟时序矫正控制系统，包括时序矫正数字电路、鉴相器、DAC芯片、外部数字电路、延时步长调节电路、模拟时钟产生电路和显示器，模拟时钟产生电路为DAC芯片提供模拟域时钟，延时步长调节电路产生与DAC芯片的模拟域时钟同频不同相的数字域时钟，鉴相器的输出端连接时序矫正数字电路的鉴相器反馈相位值输入端，时序矫正数字电路的延时步长输出端连接延时步长调节电路的输入端，时序矫正数字电路的实际相位值输出端连接显示器。本系统通过时序矫正数字电路对DAC芯片的数字域时钟进行矫正，通过鉴相器来反馈实时相位信息，自动的进行延时调整，最终把数字域时钟的相位调整到想要的位置，完成时序的矫正。

主权项

一种数模转换器的内部时钟时序矫正控制系统，其特征在于：包括时序矫正数字电路、鉴相器、DAC芯片、外部数字电路、延时步长调节电路、模拟时钟产生电路和显示器，所述外部数字电路的信号输出端连接DAC芯片的信号输入端，DAC芯片从外部数字电路中采集14位数据，所述时序矫正数字电路上设有鉴相器反馈相位值输入端、延时步长输入端、目标相位值设定端、实际相位值输出端、延时步长输出端，所述模拟时钟产生电路连接DAC芯片并为DAC芯片提供模拟域时钟，所述模拟时钟产生电路连接延时步长调节电路使延时步长调节电路产生与DAC芯片的模拟域时钟同频不同相的数字域时钟，所述模拟时钟产生电路连接鉴相器为鉴相器提供模拟域时钟，所述延时步长调节电路连接鉴相器为鉴相器提供数字域时钟，所述延时步长调节电路连接外部数字电路并为外部数字电路提供数字域时钟，所述鉴相器的输出端连接时序矫正数字电路的鉴相器反馈相位值输入端，所述时序矫正数字电路的延时步长输出端连接延时步长调节电路的输入端，所述时序矫正数字电路的实际相位值输出端连接显示器。