[发明专利]一种支持变形基16FFT算法并行访存的地址转换单元有效
| 申请号： | 201610033581.8 | 申请日： | 2016-01-19 |
| 公开（公告）号： | CN105701036B | 公开（公告）日： | 2019-03-05 |
| 发明（设计）人： | 陈海燕;杨超;刘胜;刘宗林;刘仲;万江华;陈胜刚;马胜;陈俊杰;雷元武 | 申请（专利权）人： | 中国人民解放军国防科学技术大学 |
| 主分类号： | G06F12/10 | 分类号： | G06F12/10;G06F17/14 |
| 代理公司： | 湖南兆弘专利事务所(普通合伙) 43008 | 代理人： | 周长清 |
| 地址： | 410073 湖南省长沙市开福区砚瓦池正街47号*** | 国省代码： | 湖南;43 |
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| 摘要： | 本发明公开了一种支持变形基16FFT算法并行访存的地址转换单元，包括16个相同的地址转换电路，每个所述地址转换电路均由一个三输入异或门和三个二输入异或门组成，用以实现该路运算访存或结果输出对原来按存储体低位地址编址的访存地址的变换。本发明具有实现方法简单、硬件开销小等优点。 | ||
| 搜索关键词： | 一种 支持 变形 16 fft 算法 并行 地址 转换 单元 | ||
【主权项】：
1.一种支持变形基16 FFT算法并行访存的地址转换单元，其特征在于，包括16个相同的地址转换电路，每个所述地址转换电路均由一个三输入异或门和三个二输入异或门组成，用以实现对应路的运算访存或结果输出对原来按存储体低位地址编址的访存地址的变换；将512点FFT运算数据访存所使用的9位地址标记为a[8:0]，按存储体低位交叉编址，提供所需并行访问带宽；其中，使用地址位a[3:0]以区分处理器的16个存储体，地址高位a[8:4]表示数据地址所在的行地址；将b[8:0]表示为通过所述地址转换单元进行地址转换之后的访存地址，则b[3:0]表示地址转换后的数据所在存储体地址，高位b[8:4]表示地址转换后的数据所在的存储体行地址。
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