[发明专利]时钟频率测试电路有效

专利信息
申请号: 201210004410.4 申请日: 2012-01-06
公开(公告)号: CN103197139B 公开(公告)日: 2017-03-15
发明(设计)人: 徐云秀;柴佳晶 申请(专利权)人: 上海华虹集成电路有限责任公司
主分类号: G01R23/00 分类号: G01R23/00
代理公司: 上海浦一知识产权代理有限公司31211 代理人: 戴广志
地址: 201203 上海*** 国省代码: 上海;31
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摘要: 发明公开了一种时钟频率测试方法,将测试时钟和被测试时钟分为快时钟和慢时钟,设置快时钟计数器对快时钟进行计数,设置慢时钟计数器对慢时钟进行计数;测试时的计数区间以慢时钟的计数区间为基准计数区间;系统启动测试后先启动慢时钟计数器进行计数,慢时钟计数器启动计数后再启动快时钟计数器进行计数;慢时钟计数器记满后停止计数,然后再停止快时钟计数器计数;以快时钟计数器停止计数的信号清除系统的测试启动位,读取快时钟计数器的数值,根据快时钟计数器的计数值、慢时钟计数器的计数值和已知的测试时钟的频率计算被测试时钟的频率。本发明还公开了一种时钟频率测试电路。本发明能够在有限的测试时间内得到更为精确的测试结果。
搜索关键词: 时钟 频率 测试 电路
【主权项】:
一种时钟频率测试电路,其特征在于,包括:慢时钟电路、快时钟电路和系统时钟电路;所述系统时钟电路包括:一第四D触发器,其数据输出端输出系统启动测试信号;一第三两级同步器,其数据输出端与第五D触发器的数据输入端相连接,且该数据输出端经一反向器与第四与门的一输入端相连接;一第五D触发器,其数据输出端与第四与门的另一输入端相连接;一第四与门,其输出端与所述第四D触发器的同步复位端相连接,用于检测快时钟计数器的经同步的启动信号下降沿,当检测到快时钟计数器的经同步的启动信号下降沿时,其输出信号使所述第四D触发器复位,同步清除系统启动测试信号;所述第四D触发器、第三两级同步器和第五D触发器的时钟输入端输入系统时钟信号;所述快时钟电路包括:一第二两级同步器,其数据输出端与第三D触发器的数据输入端和第三与门的一输入端相连接;一第三D触发器,其数据输出端经一反向器与第三与门的另一输入端相连接,且该数据输出端与快时钟计数器的计数使能输入端和所述第三两级同步器的数据输入端相连接;输出快时钟计数器的经同步的启动信号;一快时钟计数器,其计数输出端输出快时钟计数值;一第三与门,其输出端与所述快时钟计数器的同步复位端相连接;所述第二两级同步器、第三D触发器和快时钟计数器的时钟输入端输入快时钟信号;所述慢时钟电路包括:一第一两级同步器,其数据输入端与所述第四D触发器的数据输出端相连接,输入系统启动测试信号;其数据输出端与第一与门的一输入端和第一D触发器的数据输入端相连接;一第一D触发器,其数据输出端与第二与门的一输入端相连接,且该数据输出端经一反向器与第一与门的另一输入端相连接;一慢时钟计数器,其计数使能输入端与第二与门的输出端相连接,输入慢时钟计数器的启动信号;一第一与门,其输出端与所述慢时钟计数器的同步复位端相连接;一比较器,其反向输入端与慢时钟计数器的计数输出端相连接,其正向输入端输入参考值;一第二与门,其另一输入端与所述比较器的输出端相连接;一第二D触发器,其数据输入端与第二与门的输出端相连接;其数据输出端与所述第二两级同步器的数据输入端相连接,输出快时钟计数器的未经快时钟电路同步的启动信号;所述第一两级同步器、第一D触发器、慢时钟计数器和第二D触发器的时钟输入端输入慢时钟信号;所述第一两级同步器、第二两级同步器和第三两级同步器均由两个D触发器串联组成,用于对异步信号进行同步。
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