专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]流水线高吞吐量分层LDPC解码器架构-CN201780067344.6有效
  • V·隆科;G·瓦拉特卡;T·J·理查德森;Y·曹 - 高通股份有限公司
  • 2017-09-23 - 2023-07-04 - H03M13/11
  • 本公开的某些方面一般涉及用于解码低密度奇偶校验(LDPC)码的方法和装置,并且尤其涉及用于解决存储器一致性和冲突问题的高解码吞吐量的深度流水线分层LDPC解码器架构。本公开的各方面提出了用于缓解流水线延迟的技术,例如,通过放宽更新比特LLR和计算校验节点消息之间的依赖性,使得对于特定行,校验节点处理可以使用最新的可用的比特LLR(例如,过时的比特LLR)而非等待最新的更新(例如,经更新的比特LLR)发生。通过将最新的可用的比特LLR存储在LLR存储器中并使用旧的和新的校验节点消息之间的差异来更新比特LLR以避免存储器一致性冲突。此外,逻辑上将LLR存储器拆分成双组使得解码器能够同时从存储器的两个组读取或写入,由此增加读/写带宽。基于例如PCM中的各行之间的依赖性来有利地选择奇偶校验矩阵行(PCM)计算次序、对存储器中的校验节点消息和比特LLR更新进行排序、和/或选择存储器组以存储校验节点消息和比特LLR更新,缓解了存储器冲突/一致性错误并减少了流水线处理延迟。
  • 流水线吞吐量分层ldpc解码器架构
  • [发明专利]用于支持对等通信的方法和装置-CN201280049517.9有效
  • T·J·理查德森;V·隆科;E·纳普;S·乌帕拉;K·G·穆蒂 - 高通股份有限公司
  • 2012-10-08 - 2017-10-24 - H04W76/02
  • 描述了用于支持可在蜂窝系统中操作的多模设备中的对等和基础设施(例如,蜂窝)通信的方法和装置。还描述了用于支持对等设备的方法和装置。对等通信发生在切换时间段内,在切换时间段期间不发生基础设施信令并且设备在上行链路和下行链路基础设施工作模式之间切换。为切换时间段设置的时间段被有意地设置成大于基于最大蜂窝小区大小所需的切换时间段,例如为该所需的切换时间段的10倍、50倍、100倍或甚至更多倍。因此,对等通信时段可被引入到TDD系统中,并且以能保持与允许切换时间段(例如,在系统中由参数设置)的蜂窝通信协议兼容的方式使用与TDD系统相同的频带。
  • 用于支持对等通信方法装置
  • [发明专利]用于计算恒幅零自相关序列的装置和方法-CN200980129987.4有效
  • M·M·曼索;V·隆科 - 高通股份有限公司
  • 2009-07-23 - 2011-06-22 - G06F7/48
  • 公开了用于演算恒幅零自相关序列的装置和方法。一种方法包括至少基于输入序列根常量的加性递归并且不用与变量的乘法来演算用于演算恒幅零自相关序列的三角函数幅角。随后使用配置成不执行乘法运算且基于所演算出的幅角来演算用于确定该序列的三角函数的CORDIC算法来演算恒幅零自相关序列。所公开的方法和装置尤其可被应用于在长期演进LTE通信系统中的特定物理随机接入信道中的前置码检测中高效地计算Zadoff-Chu序列。通过允许计算此类序列,可以降低存储器要求。
  • 用于计算恒幅零相关序列装置方法

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