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[发明专利]支持端序不可知SIMD指令的处理器和方法-CN201610959252.6在审
发明人： R·J·罗扎里奥;S·兰加纳坦 -专利权人：想象技术有限公司
申请日： 2016-11-03 - 公布日： 2017-08-11 - 主分类号： G06F9/38 文献下载
摘要：支持端序不可知SIMD指令的处理器和方法。一种处理器，包括寄存器和加载存储单元(LSU)。LSU将数据从存储器加载到寄存器中。当在小端序模式下，来自依次增大的存储器地址的字节从寄存器的第一端(右端)到寄存器的第二端(左端)以对应的依次增大的字节存储器地址的顺序加载。当在大端序模式下，来自依次增大的存储器地址的字节从寄存器的第二端(左端)到寄存器的第一端(右)以对应的依次增大的存储器地址的顺序加载。因此，与以小端序模式还是以大端序模式操作无关，寄存器中的数据在其左侧具有最高有效字节，而在其右侧具有最低有效字节，这简化了SIMD指令的执行，这是因为数据对于这两种端序模式被相同地对齐。
支持不可知 simd 指令处理器方法

[实用新型]物理转换后备缓冲器TLB和可配置为支持多个可用虚拟处理元件VPE的处理器-CN201620454206.6有效
发明人： R·J·罗扎里奥;S·帕特尔 -专利权人：想象技术有限公司
申请日： 2016-05-18 - 公布日： 2017-05-03 - 主分类号： G06F12/1027 文献下载
摘要：物理转换后备缓冲器TLB和可配置为支持多个可用虚拟处理元件VPE的处理器。公开的实施方式涉及用于支持虚拟化和多线程的转换后备缓冲器的装置、系统和方法。公开的实施方式涉及包括具有可变页大小条目的内容可寻址存储器CAM和具有固定页大小条目的组相联存储器的TLB。CAM可包括逻辑上连续的第一组条目位置，其中，所述第一组包括多个子组，每个子组包括供对应的虚拟处理元件的排他使用的逻辑上连续的条目位置；不同于所述第一组的逻辑上连续的第二组条目位置，其中，所述第二组中的条目位置可在可用VPE之间共享。组相联存储器可包括不同于第一组和第二组条目位置的在可用VPE之间共享的逻辑上连续的第三组条目位置。
物理转换后备缓冲器 tlb 配置支持可用虚拟处理元件 vpe 处理器

[发明专利]转换后备缓冲器-CN201610330320.2在审
发明人： R·J·罗扎里奥;S·帕特尔 -专利权人：想象技术有限公司
申请日： 2016-05-18 - 公布日： 2016-11-30 - 主分类号： G06F12/1027 文献下载
摘要：转换后备缓冲器(TLB)。公开的实施方式涉及用于支持虚拟化和多线程的转换后备缓冲器的装置、系统和方法。公开的实施方式涉及包括具有可变页大小条目的内容可寻址存储器(CAM)和具有固定页大小条目的组相联存储器的TLB。CAM可包括：逻辑上连续的第一组条目位置，其中，所述第一组包括多个子组，每个子组包括供对应的虚拟处理元件(VPE)的排他使用的逻辑上连续的条目位置；不同于所述第一组的逻辑上连续的第二组条目位置，其中，所述第二组中的条目位置可在可用VPE之间共享。组相联存储器可包括不同于第一组和第二组条目位置的在可用VPE之间共享的逻辑上连续的第三组条目位置。
转换后备缓冲器