专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]分析方法、分析程序以及分析装置-CN201480072594.5在审
  • 山下浩一郎;铃木贵久;山内宏真;大友俊也 - 富士通株式会社
  • 2014-01-09 - 2016-08-24 - G08C25/00
  • 本发明实现能够预测系统(100)产生故障的时机。分析装置(101)检测为多个节点(#1~N)中的期间(prd)的期间发生故障的节点的个数(Nt)是2[个]。接着,分析装置(101)基于检测出的发生故障的节点的个数和期间(prd)来计算在期间(prd)以后每单位时间会发生故障的节点的个数(Nper),并输出会发生故障的节点的个数(Nper)。系统(100)的运用者阅览会发生故障的节点的个数(Nper)例如来判断是否应向系统(100)追加节点。例如如果会发生故障的节点的个数(Nper)大于系统(100)的运用者假定的值,则系统(100)的运用者判断为应向系统(100)追加节点。
  • 分析方法程序以及装置
  • [发明专利]通信方法、系统以及通信程序-CN201380076861.1在审
  • 铃木贵久;山下浩一郎;山内宏真;大友俊也 - 富士通株式会社
  • 2013-05-24 - 2016-01-13 - G08C15/00
  • 本发明涉及通信方法、系统以及通信程序。实现从通信限制严格的节点的数据收集的效率化。系统(100)具有通信装置(101)、通信装置(102),以及作为具有传感器的节点组包括节点(#1)~(#16)。通信装置(101)针对包括具有传感器的节点组的网络(104)发送传感器的数据收集请求(111)。若通信装置(102)接收到传感器的数据收集请求(111),则通信装置(102)将表示接收到数据收集请求(111)的接收信息(112)经由网络(103)发送给通信装置(101)。由此,系统(100)能够将数据的到达不经由通信限制严格的节点而传达给通信装置(101)。
  • 通信方法系统以及程序
  • [发明专利]判定方法以及系统-CN201280076970.9在审
  • 山下浩一郎;铃木贵久;山内宏真;大友俊也 - 富士通株式会社
  • 2012-11-09 - 2015-08-05 - H04W4/04
  • 计算机获取集约装置(101-B)通过多个传感器节点之间的多跳通信接收了针对由集约装置(101-A)发送并通过多个传感器节点(102)之间的多跳通信传播的发送指示的来自多个传感器节点(102)的发送信号时的、从集约装置(101-A)到第二通信装置的第一通信路径(r1)相关的第一信息。计算机从存储装置获取正常时的从集约装置(101-A)开始到被集约装置(101-B)接收为止的第二通信路径(r2)相关的第二信息。计算机通过比较第一信息和第二信息,来判定第一通信路径(r1)与第二通信路径(r2)的一致。若第一通信路径(r1)与第二通信路径(r2)不一致,则计算机判定为存在任意一个传感器节点相关的异常。
  • 判定方法以及系统
  • [发明专利]多核处理器系统、中断程序、以及中断方法-CN201510166000.3在审
  • 山下浩一郎;山内宏真;宫崎清志 - 富士通株式会社
  • 2010-02-23 - 2015-07-22 - G06F9/50
  • 本发明涉及多核处理器系统、中断程序、以及中断方法。当在应用(A)中检测出排他开始事件时,向线程(B)通知中断信号(排他开始)。当接收到排他开始事件的通知时,通过使线程(B)避让来释放从CPU(102)。由于在线程队列中存在线程(Y),从CPU(102)被分配线程(Y)。由此,在从CPU(102)中,执行线程(Y)。当线程(Y)结束时,线程队列是空的,因此转移到低功率模式。之后,当在应用(A)中检测出排他结束事件时,从应用(A)向从CPU(102)通知中断信号(排他结束)。在从CPU(102)中,当接收到排他结束事件的通知时,在从CPU(102)中恢复线程(B)。由此,能够从使线程(B)避让的位置再次执行。
  • 多核处理器系统中断程序以及方法
  • [发明专利]多核处理器系统-CN201180069869.6有效
  • 山下浩一郎;山内宏真;铃木贵久;栗原康志 - 富士通株式会社
  • 2011-03-28 - 2014-01-01 - G06F11/16
  • 本发明提供一种多核处理器系统。在混搭了高可靠应用(112)和低可靠应用(111)的状态下运用多核处理器系统(100)。多核处理器系统(100)处于CPU(#1)执行低可靠应用(111)并且CPU(#2)执行高可靠应用(112)的状态。存储器保护控制器(106#2)访问用户区域(121)内的高可靠应用存储器区域(123),并且访问保护区域(124)内的高可靠应用存储器区域(125)。在由于低可靠应用(111)进行不正确写入而破坏了高可靠应用存储器区域(123)的数据的情况下,CPU(#2)通过向高可靠应用存储器区域(123)复制高可靠应用存储器区域(125)的数据来复原数据。
  • 多核处理器系统
  • [发明专利]处理器管理方法-CN201180067933.7在审
  • 山下浩一郎;山内宏真;铃木贵久;栗原康志 - 富士通株式会社
  • 2011-02-21 - 2013-11-20 - G06F11/20
  • 本发明涉及处理器管理方法。向用户提供低价且高性能的系统。系统(100)由具有处理器的SoC(108)和包括存储器(109)的域(107)的集合构建。此时,系统(100)对域(107#0)内的处理器设定管理域(107#0)~域(107#2)的主机构。同样,系统(100)对域(107#1)的处理器设定管理自身的局域主机构、将主上下文镜像变换为自域内的存储器(109)的虚拟主机构。域(107#0)内的处理器向域(107#0)~域(107#2)通知如存储器(109#0)~存储器(109#2)的逻辑地址连续那样的偏移值。
  • 处理器管理方法
  • [发明专利]信息处理系统-CN201080070129.X有效
  • 山下浩一郎;山内宏真;铃木贵久;栗原康志;早川文彦 - 富士通株式会社
  • 2010-11-15 - 2013-07-17 - G06F12/08
  • 本发明涉及信息处理系统,抑制信息处理系统(100)的消耗电力,同时消除共享资源(106)的访问冲突。总线控制器(108)利用高速缓存缺失检测部(119),来检测表示CPU(101)、CPU(102)的高速缓存命中或者高速缓存缺失的第1信息。另外,总线控制器(108)利用高速I/O检测部(120),来检测表示DMA控制器(103)、DMA控制器(104)的激活状态或者非激活状态的第2信息。总线控制器(108)利用生成部(123),基于第1信息和第2信息生成设定信号。
  • 信息处理系统
  • [发明专利]多核处理器系统,控制程序以及控制方法-CN201080067572.1有效
  • 铃木贵久;山下浩一郎;山内宏真;栗原康志 - 富士通株式会社
  • 2010-06-22 - 2013-05-15 - G06F12/08
  • 本发明涉及多核处理器系统,控制程序以及控制方法。OS(191)若将线程2分配给CPU(102),则OS(191)将输出数据项的输出数据为变量z、并且输入目标线程的识别信息项的输入目标线程的识别信息为线程2时的分配目标CPU的识别信息项的分配目标CPU的识别信息更新为CPU(102)。OS(191)将输出数据项的输出数据为变量x、并且输入目标线程的识别信息项的输入目标线程的识别信息为线程2时的分配目标CPU的识别信息项的分配目标CPU的识别信息更新为CPU(102)。OS(191)若检测到变量x的写入请求,则OS(191)将变量x作为检索关键字从表中检索分配目标CPU的识别信息项的分配目标CPU的识别信息,由此确定分配目标CPU的识别信息,基于确定结果向CPU(102)的分散高速缓存(112)储存变量x。
  • 多核处理器系统控制程序以及控制方法

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