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[发明专利]图像处理电路、显示装置及打印装置-CN200810188783.5无效
发明人：小野义之;泽崎高;斋藤明 -专利权人：精工爱普生株式会社
申请日： 2008-08-12 - 公布日： 2009-06-17 - 主分类号： G06T1/20 文献下载
摘要：图像处理电路包括：存储装置，其存储有构成并列配置的多个图形图像的各个像素的位置及其像素值；第一乘法运算装置，其将存储在上述存储装置中的各个位置的像素值以及表示各个位置的像素值的输入图像数据中所包括的像素值，在每一个分别对应的上述位置相乘；差值输出装置，其输出将上述输入图像数据中包括的各位置的像素值从该输入图像数据中包括的最大像素值减去后的像素值；第二乘法运算装置，其将在上述输入图像数据中包含的各个位置的像素值或者根据该输入图像数据成为图像的背景的背景图像数据中包括的各个位置的像素值，与由上述差值输出装置反转后的像素值，在每一个分别对应的上述位置相乘；和加法装置，其将上述第一乘法运算装置的乘法运算结果和上述第二乘法运算装置的乘法运算结果在每一个分别对应的上述位置相加，并作为输出图像数据输出。
图像处理电路显示装置打印装置

[发明专利]图像处理电路、显示装置以及印刷装置-CN200810145951.2有效
发明人：小野义之;泽崎高;斋藤明 -专利权人：精工爱普生株式会社
申请日： 2008-08-14 - 公布日： 2009-02-18 - 主分类号： G06T1/20 文献下载
摘要：本发明提供一种图像处理电路、显示装置及印刷装置，只在输入图像的描绘区域排列多个图形图像，且实施能从该描绘区域的一部分看到背景图像的阴影化处理。选择器(S1)在输入图像数据的像素值为“1”且对应的位置的图案比特值为“0”的情况下，将该像素值变换成0输出，除此以外的情况下直接输出该像素值。乘法器(MU0)按每个对应的位置将图案比特值和由选择器输出的像素值相乘。减法器(SU)将由选择器输出的像素值反相并输出。乘法器(MU1)将基于输入图像数据的图像的背景颜色信息的像素值和由减法器反相的像素值按每个对应的位置相乘。加法器(AD)将乘法器的乘法运算结果和乘法器的乘法运算结果按每个对应的位置相加，作为输出图像数据输出。
图像处理电路显示装置以及印刷装置

[发明专利]图像处理电路、显示装置以及印刷装置-CN200810145953.1有效
发明人：小野义之;泽崎高;斋藤明 -专利权人：精工爱普生株式会社
申请日： 2008-08-14 - 公布日： 2009-02-18 - 主分类号： G06T1/20 文献下载
摘要：本发明提供一种图像处理电路，可在输入图像的描绘区域实施阴影化处理时，尽可能缩小该阴影图案所包含的图形图像和输入图像的描绘区域之间的偏离。存储器存储阴影图案数据。CPU算出目标位置和图形图像的始点的位置的差值，移位电路输出从存储器的各图案比特值的位置偏离算出的差值后的位置的像素值。乘法器(MU0)将从移位电路输出的各图案比特值和输入图像数据的各像素值按每个对应的位置相乘。减法器输出使输入图像数据的各像素值反相后的值。乘法器(MU1)将背景颜色信息和从减法器输出的值按每个对应的位置相乘。加法器将乘法器(MU0)的乘法运算结果和乘法器(MU1)的乘法运算结果按每个对应的位置相加，作为输出图像数据输出。
图像处理电路显示装置以及印刷装置

[发明专利]文字描绘装置、显示装置以及印刷装置-CN200710197000.5无效
发明人： 泽崎高;小野义之;斋藤明 -专利权人：精工爱普生株式会社
申请日： 2007-12-07 - 公布日： 2008-10-01 - 主分类号： G09G5/24 文献下载
摘要：本发明提供一种更加高速描绘文字的文字描绘装置。CPU，计算可写入内部存储器上的文字的高度(SA11)，将该值除以所写入的文字的高度，计算分割数m(SA12)。CPU，当判断分割数m不超过规定值P(SA13：否)时，则作为分割数m，选择使用内部存储器(SA14、15)。CPU，当判断分割数m超过规定值P时(SA13：是)，则计算可写入RAM上的文字的高度(SA16)，将该值除以所写入的文字的高度，计算分割数n(SA17)。作为分割数n，CPU选择使用RAM(SA18、19)。按照以上方式，当内部存储器中分割数超过规定值P时，CPU选择分割数少的RAM，因此能够使用可实现高速处理的存储器。
文字描绘装置显示装置以及印刷

[发明专利]图像处理电路、显示装置以及印刷装置-CN200710199868.9有效
发明人：小野义之;泽崎高;斋藤明 -专利权人：精工爱普生株式会社
申请日： 2007-12-14 - 公布日： 2008-09-17 - 主分类号： G06T1/00 文献下载
摘要：本发明提供一种图像处理电路、显示装置以及印刷装置，在抗混叠电路(250)中，设置了用成为VRAM中的数据的写入单位的位数除以输出图像数据中的每一个像素的位数得到的数目以上的16个位计数器(251)。抗混叠电路(250)从所输入的图像数据中提取包括16个或4个像素的多个图像块，基于提取的各个图像块所包括的像素的像素值，输出表示将各个图像块作为一个像素时的像素值的32位的位串。从抗混叠电路(250)输出的32位的位串，通过1次的存储器访问被写入到VRAM。从而能够缩短从抗混叠处理到将其处理结果写入到存储单元之前所需要的时间。
图像处理电路显示装置以及印刷装置

[发明专利]字符描绘装置、显示装置和印刷装置-CN200810002408.7无效
发明人： 泽崎高;小野义之;斋藤明 -专利权人：精工爱普生株式会社
申请日： 2008-01-07 - 公布日： 2008-08-20 - 主分类号： G06T11/20 文献下载
摘要：本发明的目的在于更高速地描绘字符。本发明的字体处理器使用工作存储器(1)执行第1个字符描绘中的轮廓描绘a。接着，字体处理器开始涂布a，另一方面，使用工作存储器(2)开始第2个字符的字符描绘中的轮廓描绘b。当第1个字符的描绘结束、并且轮廓描绘b完成时，字体处理器使用工作存储器(1)执行第3个字符描绘中的轮廓描绘c，另一方面，执行第2个字符描绘中的涂布b和合成/传输b。如上所述，字体处理器按如下方式执行并行动作，即使用一个工作存储器进行轮廓描绘，另一方面，使用另一个工作存储器进行涂布和背景合成/传输。因此，可高速描绘字符。
字符描绘装置显示装置印刷