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[发明专利]一种应用于lte的pbch卷积码快速译码装置及方法-CN201410728305.4有效
发明人： 曾献敏;康忠林;卓开泳;刘玉玲 -专利权人：福建京奥通信技术有限公司
申请日： 2014-12-04 - 公布日： 2019-02-12 - 主分类号： H04L1/00 文献下载
摘要：本发明公开一种应用于lte的pbch卷积码快速译码装置及方法，其中，装置包括多个存储深度为32的路径存储单元，其用于存储多路路径的卷积码译码结果；路径距离增加计算单元，用于计算每一路假设的译码结果引起的路径距离增加量；路径距离比较单元，用于对64路的路径距离增加量进行比较；路径更新单元，用于对路径迭代更新输出译码结果；所述路径距离增加计算单元、路径距离比较单元、路径更新单元依次连接，所述路径存储单元分别与路径距离增加计算单元及路径更新单元连接。本发明的pbch卷积码快速译码装置及方法，构造简单，译码迅速，准确率高。
一种应用于 lte pbch 卷积码快速译码装置方法

[实用新型]WCDMA中继器下行信道参数估计系统-CN201820271034.8有效
发明人： 曾献敏;康忠林 -专利权人：福建京奥通信技术有限公司
申请日： 2018-02-26 - 公布日： 2018-11-16 - 主分类号： H04L25/02 文献下载
摘要：本实用新型公开了一种WCDMA中继器下行信道参数估计系统，包括在WCDMA系统发送的公共导频信道上生成邻区CPICH发射信号；对公共导频信号（CPICH）进行解扰解扩计算；根据解扰解扩后得到的数据进行相关计算，得出原始信道估计；对原始信道估计值做平滑处理，得到更为准确的真实值；本实用新型通过对WCDMA系统发送的CPICH信道进行解扰解扩，然后通过相关算法得到原始信道估计；在保障算法估计精度高的前提下，使得所需资源少、计算复杂度低及有效降低误码率。
解扰解扩原始信道下行信道参数本实用新型估计系统中继器发送公共导频信道公共导频信号计算复杂度发射信号平滑处理算法估计误码率邻区算法信道

[发明专利]WCDMA中继器下行信道参数估计系统及方法-CN201810162155.3在审
发明人： 曾献敏;康忠林 -专利权人：福建京奥通信技术有限公司
申请日： 2018-02-26 - 公布日： 2018-06-29 - 主分类号： H04L25/02 文献下载
摘要：本发明公开了一种WCDMA中继器下行信道参数估计系统及方法，包括在WCDMA系统发送的公共导频信道上生成邻区CPICH发射信号；对公共导频信号（CPICH）进行解扰解扩计算；根据解扰解扩后得到的数据进行相关计算，得出原始信道估计；对原始信道估计值做平滑处理，得到更为准确的真实值；本发明通过对WCDMA系统发送的CPICH信道进行解扰解扩，然后通过相关算法得到原始信道估计；在保障算法估计精度高的前提下，使得所需资源少、计算复杂度低及有效降低误码率。
解扰解扩原始信道下行信道参数估计系统中继器发送公共导频信道公共导频信号计算复杂度发射信号平滑处理算法估计误码率邻区算法信道

[发明专利]FDD‑LTE直放站-CN201510195447.3有效
发明人： 曾献敏;康忠林;卓开泳 -专利权人：福建京奥通信技术有限公司
申请日： 2015-04-23 - 公布日： 2017-11-10 - 主分类号： H04B7/155 文献下载
摘要：FDD‑LTE直放站包括上行接收天线、上行发射天线、第一射频收发芯片、下行接收天线、下行发射天线、第二射频收发芯片和FPGA芯片；上行接收天线连接第一射频收发芯片的第一混频器，下行发射天线连接第一射频收发芯片的第二混频器，第一射频收发芯片的前端衰减器和后端衰减器分别连接FPGA芯片；下行接收天线连接第二射频收发芯片的第一混频器，上行发射天线连接第二射频发射芯片的第二混频器，第二射频收发芯片的前端衰减器和后端衰减器分别连接FPGA芯片。本发明大大减少元器件，简化电路布线，缩小直放站的体积，方便后期维护，提高生产效率和降低生产成本。本发明还涉及相关方法。
fdd lte 直放站

[实用新型]FDD-LTE直放站-CN201520250673.2有效
发明人： 曾献敏;康忠林;卓开泳 -专利权人：福建京奥通信技术有限公司
申请日： 2015-04-23 - 公布日： 2015-08-19 - 主分类号： H04B7/155 文献下载
摘要：FDD-LTE直放站包括上行接收天线、上行发射天线、第一射频收发芯片、下行接收天线、下行发射天线、第二射频收发芯片和FPGA芯片；上行接收天线连接第一射频收发芯片的第一混频器，下行发射天线连接第一射频收发芯片的第二混频器，第一射频收发芯片的前端衰减器和后端衰减器分别连接FPGA芯片；下行接收天线连接第二射频收发芯片的第一混频器，上行发射天线连接第二射频发射芯片的第二混频器，第二射频收发芯片的前端衰减器和后端衰减器分别连接FPGA芯片。本实用新型大大减少元器件，简化电路布线，缩小直放站的体积，方便后期维护，提高生产效率和降低生产成本。本实用新型还涉及相关方法。
fdd lte 直放站

[发明专利]一种下行同步系统及方法-CN201310714938.5在审
发明人： 曾献敏;卢芳仕;焦博;卓开泳;康忠林 -专利权人：福建京奥通信技术有限公司
申请日： 2013-12-23 - 公布日： 2015-06-24 - 主分类号： H04W56/00 文献下载
摘要：本发明涉及通信技术领域，特别是涉及基于LTE-TDD下行同步码互相关性的下行同步系统及其方法。本发明的一种下行同步系统，包括：第一天线，第二天线，第一LTE-TDD上下行切换开关，第二LTE-TDD上下行切换开关，一模数转换处理单元，第一复混频处理单元，一数字下变频处理单元，一LTE-TDD下行同步处理单元，一LTE-TDD上下行切换控制单元，一数字上变频处理单元，第二复混频处理单元以及一数模转换处理单元。本发明通过LTE-TDD下行同步处理单元对下行同步码进行自相关性处理，来得到对上下行切换开关的控制信号，再通过对第一LTE-TDD上下行切换开关和第二LTE-TDD上下行切换开关的控制从而实现上下行链路的选择。该系统及其方法实现容易、成本低且精度高。
一种下行同步系统方法

[实用新型]一种应用于lte的pbch卷积码快速译码装置-CN201420752278.X有效
发明人： 曾献敏;康忠林;卓开泳;刘玉玲 -专利权人：福建京奥通信技术有限公司
申请日： 2014-12-04 - 公布日： 2015-04-08 - 主分类号： H04L1/00 文献下载
摘要：本实用新型公开一种应用于lte的pbch卷积码快速译码装置，其中，装置包括多个存储深度为32的路径存储单元，其用于存储多路路径的卷积码译码结果；路径距离增加计算单元，用于计算每一路假设的译码结果引起的路径距离增加量；路径距离比较单元，用于对64路的路径距离增加量进行比较；路径更新单元，用于对路径迭代更新输出译码结果；所述路径距离增加计算单元、路径距离比较单元、路径更新单元依次连接，所述路径存储单元分别与路径距离增加计算单元及路径更新单元连接。本实用新型的pbch卷积码快速译码装置及方法，构造简单，译码迅速，准确率高。
一种应用于 lte pbch 卷积码快速译码装置

[实用新型]TD-SCDMA直放站的下行同步系统-CN201120384271.3有效
发明人：康忠林;卓开泳;叶天宝;曾献敏;卢方仕;肖庆云;高心炜 -专利权人：福建京奥通信技术有限公司
申请日： 2011-10-10 - 公布日： 2012-08-01 - 主分类号： H04B7/26 文献下载
摘要：本实用新型公开了一种TD-SCDMA直放站的下行同步系统，该系统包括第一天线、第二天线、第一TD上下行切换开关、第二TD上下行切换开关、模数转换处理单元、第一复混频处理单元、数字下变频处理单元、TD下行同步处理单元、TD上下行切换控制单元、数字上变频处理单元、第二复混频处理单元、数模转换处理单元和功放模块，通过TD下行同步处理单元对下行同步码进行自相关性处理，来得到对上下行切换开关的控制信号，再通过对上下行切换开关的控制从而实现上下行链路的选择。该系统具有实现容易，成本低的特点。
td scdma 直放站下行同步系统

[发明专利]TD-SCDMA直放站的基于下行同步码自相关性的下行同步系统及其方法-CN201110304664.3有效
发明人：康忠林;卓开泳;叶天宝;曾献敏;卢方仕;肖庆云;高心炜 -专利权人：福建京奥通信技术有限公司
申请日： 2011-10-10 - 公布日： 2012-05-09 - 主分类号： H04B7/26 文献下载
摘要：本发明公开了一种TD-SCDMA直放站的基于下行同步码自相关性的下行同步系统及其方法，该系统包括第一天线、第二天线、第一TD上下行切换开关、第二TD上下行切换开关、模数转换处理单元、第一复混频处理单元、数字下变频处理单元、TD下行同步处理单元、TD上下行切换控制单元、数字上变频处理单元、第二复混频处理单元、数模转换处理单元和功放模块，通过TD下行同步处理单元对下行同步码进行自相关性处理，来得到对上下行切换开关的控制信号，再通过对上下行切换开关的控制从而实现上下行链路的选择。该系统及其方法具有实现容易，成本低的特点。
td scdma 直放站基于下行同步相关性系统及其方法

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