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[发明专利]用于在基于处理器的系统中运行时检查存储器标签的方法、设备和系统-CN202180068019.8在审
发明人： B·C·查芬;B·L·托尔;J·C·佩里;N·阿布莱奈恩 -专利权人： 安培计算有限责任公司
申请日： 2021-08-04 - 公布日： 2023-06-27 - 主分类号： G06F12/0862 文献下载
摘要：一种数据处理系统包含存储数据路径，所述存储数据路径被配置成在存储操作中对与存储器中的高速缓存线相关联的存储地址执行标签检查。所述存储数据路径包含高速缓存查找电路，所述高速缓存查找电路被配置成预加载要在所述存储操作中更新的存储高速缓存线，其中所述存储高速缓存线包括所述存储器中的要在所述存储操作中更新的所述高速缓存线。所述存储数据路径还包含标签检查电路，所述标签检查电路被配置成将与所述存储地址相关联的存储地址标签和与所述存储操作相关联的存储操作标签进行比较。所述数据处理系统可以包含加载数据路径，所述加载数据路径被配置成通过将与加载地址相关联的加载地址标签和与加载操作相关联的加载操作标签进行比较，在所述加载操作中对所述存储器中的加载高速缓存线执行标签检查。
用于基于处理器系统运行检查存储器标签方法设备

[发明专利]优化与网络节点相关联的内存映射-CN201780085451.1有效
发明人：安基特·金达尔;普纳库玛尔·萨瓦高卡尔;柯优尔·楚加尔 -专利权人： 安培计算有限责任公司
申请日： 2017-11-30 - 公布日： 2023-06-23 - 主分类号： G06F12/02 文献下载
摘要：各种方面提供了优化与网络节点相关联的内存映射。例如，系统可包括第一网络节点和第二网络节点。所述第一网络节点响应于与所述第一网络节点的虚拟中央处理单元相关联的无效内存访问生成内存页请求。所述第二网络节点响应于所述第二网络节点包括与所述内存页请求相关联的内存空间的确定接收所述内存页请求。所述第一网络节点还基于由所述第一网络节点储存的一组内存页映射，来映射与所述内存页请求相关联的内存页。
优化网络节点相关内存映射

[发明专利]缓解处理器中的返回堆栈缓冲区旁侧信道攻击-CN202180057381.5在审
发明人： B·C·查芬;B·L·托尔;M·S·秦 -专利权人： 安培计算有限责任公司
申请日： 2021-08-04 - 公布日： 2023-05-12 - 主分类号： G06F9/38 文献下载
摘要：缓解处理器中的返回堆栈缓冲区旁侧信道攻击。检测所述处理器中的旁侧信道攻击或来自函数调用的返回中的故障包含接收指示与所述返回相关联的异常级别的返回异常级别指示(或例如，返回安全级别指示)，以及将与所述返回相关联的所述异常级别同与所述返回地址相关联的所述异常级别(或安全级别)进行比较。可结合返回指示接收返回异常级别指示符。所述处理电路存取指示所述函数调用的所述返回地址的返回堆栈缓冲区的第一条目，并且还存取与所述返回地址相关联的异常级别。所述处理电路将与所述返回地址相关联的所述异常级别同与所述返回相关联的所述异常级别进行比较以确定是否在指令流的预测中使用所述返回地址。
缓解处理器中的返回堆栈缓冲区旁侧信道攻击

[发明专利]虚拟三路解耦预测和获取-CN202180050883.5在审
发明人： B·A·艾尔兰;M·S·秦;S·J·乔丹 -专利权人： 安培计算有限责任公司
申请日： 2021-06-18 - 公布日： 2023-03-31 - 主分类号： G06F9/38 文献下载
摘要：公开了一种被配置为执行解耦预测和获取操作的统一队列，以及相关的设备、系统、方法和计算机可读介质。所述统一队列具有多个条目，其中每个条目被配置为存储与至少一个指令相关联的信息，并且其中所述信息包含标识符部分、预测信息部分和标记信息部分。所述统一队列被配置为响应于预测块更新每个条目的所述预测信息部分，以及响应于标记和TLB块更新每个条目的所述标记信息部分。所述预测信息可以被更新不止一次，并且所述统一队列被配置为在稍后的预测与较早的预测冲突的情况下采取校正动作。
虚拟三路解耦预测获取

[发明专利]单芯片服务器中的讯流钉扎-CN201580082192.8有效
发明人： K·丘德加尔;K·桑卡兰 -专利权人： 安培计算有限责任公司
申请日： 2015-07-24 - 公布日： 2022-07-26 - 主分类号： H04L47/50 文献下载
摘要：一种进行讯流钉扎的单芯片系统或单芯片服务器，于此，使封包或封包串流进入特定队列，其中各队列与多处理器/多核心系统或单芯片服务器中的相应核心相关联。凭借指定予特定处理器的各封包串流、或讯流，该单芯片服务器可从来自相同单一以太网络接口的多条串流平行处理及摄取出自多个队列的封包。该等队列各可对其指定的处理器发布中断，容许该等处理器各同时自其相应队列接收封包。
芯片服务器中的讯流钉扎

[发明专利]自参考片上电压下降检测器-CN201780028740.8有效
发明人：种燕;卢卡·拉弗齐;阿尔佛雷德·杨;哈米德·帕尔托维 -专利权人： 安培计算有限责任公司
申请日： 2017-03-13 - 公布日： 2022-03-25 - 主分类号： G01R19/165 文献下载
摘要：自参考片上电压下降检测器根据集成电路的配电网络的电源电压生成参考电压，并且将该参考电压与瞬态电源电压比较以便检测电压下降。由于位于片上，检测器以低延迟响应检测到的电压下降的发生。而且，通过从集成电路的电源域生成参考电压而不是使用单独的参考电压源，检测器不会引入与单独的电源域相关联的噪声和失真。
参考电压下降检测器

[发明专利]高频电压供应监测器-CN201580082032.3有效
发明人： L·拉韦兹齐;Q·哈佛;H·帕尔托维 -专利权人： 安培计算有限责任公司
申请日： 2015-07-29 - 公布日： 2021-08-31 - 主分类号： G01R19/165 文献下载
摘要：一种高频电压供应监测器，其能够实质即时监测微电子电路内部电压供应的高频变动。该电压供应监测器可包含在大频宽内具有实质恒定增益的差动放大器电路，容许在宽广的条件范围下根据已知增益将该供应电压变动放大。接着，可将该已放大信号发送至输出接口以供通过外部显示装置进行监测及测量。
高频电压供应监测器

[发明专利]用于促进移出的预取标记-CN201580080376.0有效
发明人：谢尔·斯文森 -专利权人： 安培计算有限责任公司
申请日： 2015-07-30 - 公布日： 2020-10-27 - 主分类号： G06F12/0862 文献下载
摘要：描述了一种将数据从主存储器中预取到缓存，然后将不使用的数据移出到较低级别的缓存的系统。该预取系统将数据从主存储器中预取到缓存，并且不立即使用、或者是太大而不能放入缓存的数据集的一部分的数据能够被标记以移出到较低级别的缓存，与必须从主存储器中再次加载数据相比，使得能够用较短的延迟得到数据。这大大降低了预取可用数据的成本，并且防止缓存垃圾。
用于促进移出标记

[发明专利]封装可编程去耦电容器阵列-CN201680063584.4有效
发明人：瑞驰·泰克;阿尔弗雷德·杨;爱普·兰伯特;杰瑞米·普伦凯特 -专利权人： 安培计算有限责任公司
申请日： 2016-08-26 - 公布日： 2020-06-12 - 主分类号： H01L23/522 文献下载
摘要：在电路设计完成之后，半导体芯片允许选定的片上去耦电容量连接到超大规模集成电路(VLSI)系统。半导体芯片包括设置在封装衬底上的集成电路以及通过封装衬底经由可编程连接阵列电连接到集成电路的配电网络。
封装可编程电容器阵列

[发明专利]依DMB操作用加载/存储操作实施加载撷取/存储释放指令-CN201910999320.5在审
发明人： M·阿什克拉夫特;C·纳尔逊 -专利权人： 安培计算有限责任公司
申请日： 2015-07-21 - 公布日： 2020-02-14 - 主分类号： G06F9/30 文献下载
摘要：本申请涉及依DMB操作用加载/存储操作实施加载撷取/存储释放指令。提供用于将精简指令集运算(RISC)中使用的加载撷取与存储释放语意简化的系统及方法。将该语意转译成用于实施复杂机器指令的微操作、或低阶指令，可避免必须实施复杂的新存储器操作。当数据存储器屏障确保居前指令是在执行后续指令之前先进行及完成时，搭配加载与存储操作使用一或多个数据存储器的屏障操作可提供充分定序。
加载指令数据存储器存储操作语意撷取存储存储器操作精简指令集复杂机器后续指令屏障操作释放完成时微操作低阶转译运算搭配屏障申请

[发明专利]依DMB操作用加载/存储操作实施加载撷取/存储释放指令-CN201580082189.6有效
发明人： M·阿什克拉夫特;C·纳尔逊 -专利权人： 安培计算有限责任公司
申请日： 2015-07-21 - 公布日： 2019-11-15 - 主分类号： G06F9/30 文献下载
摘要：提供用于将精简指令集运算(RISC)中使用的加载撷取与存储释放语意简化的系统及方法。将该语意转译成用于实施复杂机器指令的微操作、或低阶指令，可避免必须实施复杂的新存储器操作。当数据存储器屏障确保居前指令是在执行后续指令之前先进行及完成时，搭配加载与存储操作使用一或多个数据存储器的屏障操作可提供充分定序。
加载数据存储器存储操作指令语意撷取存储存储器操作精简指令集复杂机器后续指令屏障操作指令提供释放完成时微操作低阶转译运算搭配屏障

[发明专利]基于与微处理器相关联的电压的时钟控制-CN201780066882.3在审
发明人：大卫·奥利弗;马修·W·阿什克拉夫特;卢卡·拉韦齐;阿尔佛雷德·杨;约翰·格雷戈里·费沃 -专利权人： 安培计算有限责任公司
申请日： 2017-08-08 - 公布日： 2019-07-02 - 主分类号： G06F1/30 文献下载
摘要：各方面提供用于(例如，通过控制与微处理器相关联的时钟)减轻与微处理器相关联的电压下降。例如，系统能够包括微处理器和控制器。微处理器能够接收由时钟缓冲器提供的时钟。控制器能够基于与微处理器相关联的电压来控制由时钟缓冲器提供的时钟的频率。一方面，控制器能够响应于确定电压满足定义的条件而降低时钟频率。另外，控制器能够响应于在电压满足该定义的条件后又确定电压满足另一定义的条件，而逐渐增加时钟频率。
微处理器控制器关联时钟缓冲器时钟频率电压下降时钟控制逐渐增加响应

[发明专利]高效率半交叉耦合去耦电容器-CN201580080820.9有效
发明人：阿尔佛雷德·杨;罗恩·科汉 -专利权人： 安培计算有限责任公司
申请日： 2015-07-30 - 公布日： 2019-06-11 - 主分类号： H03K19/094 文献下载
摘要：去耦电容器电路设计在不牺牲面积效率的情况下促进了高工作频率。为了解除高工作频率和面积效率的有时相反的设计标准，以半交叉耦合(HCC)的方式来连接p沟道场效应晶体管(PFET)和n沟道场效应晶体管。然后由至少一个面积有效电容(AEC)器件来补充HCC电路。半交叉耦合晶体管满足了高频设计要求，同时AEC器件满足了高面积效率要求。该设计消除了一些常规的DCAP设计中工作频率和面积效率之间固有的不期望的折中。
面积效率半交叉高工作频率去耦电容器耦合耦合晶体管电路设计高频设计工作频率设计标准有效电容常规的高效率电路期望补充

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