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专利名称

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申请人
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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]使用固定功能操作的对所卸载指令的处理器引导的执行-CN202180085238.7在审
发明人：约翰·卡拉马丁纳斯;迈克尔·T·克拉克;马吕斯·埃弗斯;威廉·L·瓦尔克;保罗·莫耶;杰伊·弗莱施曼;贾格迪什·B·科特拉 -专利权人：超威半导体公司
申请日： 2021-12-14 - 公布日： 2023-08-29 - 主分类号： G06F9/38 文献下载
摘要：本发明公开了使用固定功能操作的对所卸载指令的处理器引导的执行。被指定用于由目标设备远程执行的指令由处理器接收。每个指令包括该目标设备中的作为操作数的目标寄存器。该目标寄存器可以是架构的虚拟寄存器。针对多个指令中的每一个指令，该处理器按这些指令被接收的顺序来传输卸载请求。该卸载请求包括被指定用于远程执行的指令。该目标设备可以是例如存储器内嵌处理设备或耦合到存储器的加速器。
使用固定功能操作卸载指令处理器引导执行

[发明专利]使用时钟唤醒抑制的环式传输-CN202080073997.7在审
发明人： 威廉·L·瓦尔克 -专利权人：超威半导体公司
申请日： 2020-10-22 - 公布日： 2022-05-27 - 主分类号： G06F1/324 文献下载
摘要：一种集成电路(IC)器件包括环式传输，所述环式传输具有多个节点和将所述多个节点耦合成环的线互连。所述线互连包括用于在表示数据包的数据信令之前围绕所述环式传输传送时钟唤醒信号的线。每个节点将响应于接收到时钟唤醒信号而从时钟门控状态切换到定时状态。所述环式传输还包括睡眠控制器，所述睡眠控制器耦合到所述多个节点中的选择节点。所述睡眠控制器将响应于通过对所述线的监视识别出所述环式传输上的空闲状况，将所述选择节点在指定的持续时间内配置成时钟抑制状态。在处于所述时钟抑制状态时，所述节点抑制在所述选择节点处接收到的任何时钟唤醒信号的进一步传送。
使用时钟唤醒抑制传输

[发明专利]将高速缓存线从共用存储器页面冲洗到存储器-CN201880080249.4在审
发明人： 威廉·L·瓦尔克;威廉·E·琼斯 -专利权人：超威半导体公司
申请日： 2018-09-24 - 公布日： 2020-07-31 - 主分类号： G06F12/0871 文献下载
摘要：处理系统(100)从高速缓存(302)冲洗共享与被识别用于驱逐的高速缓存线(304)相同的存储器页面(147)的那些高速缓存线(308、309)。所述处理系统的高速缓存控制器(175)将所述高速缓存线识别为被调度用于驱逐。作为响应，所述高速缓存控制器识别与所述相同存储器页面相关联的额外“脏牺牲”高速缓存线(已经在所述高速缓存处被修改但尚未写回到存储器的高速缓存线)，并且将所述所识别的高速缓存线中的每一者写入到存储器(105)中的相同存储器页面。通过将与所述存储器页面相关联的所述脏牺牲高速缓存线中的每一者写入到存储器，所述处理系统减少了存储器开销并且改善了处理效率。
高速缓存共用存储器页面冲洗

[发明专利]用以约束存储器带宽利用的存储器请求限制-CN201880080230.X在审
发明人： 威廉·L·瓦尔克;威廉·E·琼斯 -专利权人：超威半导体公司
申请日： 2018-08-28 - 公布日： 2020-07-28 - 主分类号： G06F12/0862 文献下载
摘要：一种处理系统(100)，包括能够耦接到本地存储器(112)的互连结构(110)以及耦接到所述互连结构的至少一个计算复合体(102)。所述计算复合体包括处理器核心(114至117)和高速缓存分级体系(118)。所述高速缓存分级体系具有多个高速缓存(121至130)和限制控制器(228)，所述限制控制器被配置来基于访问等待时间度量和预取准确度度量中的至少一者来限制所述处理器核心能够发布的存储器请求的速率。所述访问等待时间度量表示用于所述处理器核心的存储器请求的平均访问等待时间，并且所述预取准确度度量表示所述高速缓存分级体系的高速缓存的预取器(220)的准确度。
用以约束存储器带宽利用请求限制

[发明专利]在断电状态期间保留处理器内核的高速缓存条目-CN201880071347.1在审
发明人： 威廉·L·瓦尔克;迈克尔·L·戈尔登;马吕斯·埃弗斯 -专利权人：超威半导体公司
申请日： 2018-09-14 - 公布日： 2020-06-26 - 主分类号： G06F12/0891 文献下载
摘要：与第一高速缓存(205)相关联的处理器内核(215)开始进入断电状态。作为响应，将表示所述第一高速缓存的一组条目(220)的信息存储在保留区域(230)中，所述保留区域在所述处理器内核处于断电状态时接收保留电压。将指示所述一组条目中的一个或多个失效条目的信息也存储在所述保留区域中。响应于所述处理器内核开始从所述断电状态退出，使用表示所述条目的所述所存储的信息和指示所述至少一个失效条目的所述所存储的信息来恢复所述第一高速缓存的条目。
断电状态期间保留处理器内核高速缓存条目

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