专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]像素结构、主动阵列基板及液晶显示面板-CN201110396163.2有效
  • 刘晋炜;陈文彬 - 友达光电股份有限公司
  • 2011-11-29 - 2012-05-02 - G02F1/1362
  • 本发明公开公开一种像素结构、主动阵列基板及显示面板,其中主动阵列基板包括基板、多条数据线、多条第一栅极线与多条第二栅极线、多个第一像素电极、多个第二像素电极以及多条遮蔽电极。每一第一像素电极电性连接数据线与第二栅极线。每一第二像素电极电性连接数据线与第一栅极线。每一遮蔽电极具有连接线段以及多个分支线段,每一遮蔽电极位于相邻的两条数据线之间,且每一连接线段位于第一像素电极与第二像素电极之间,每一分支线段位于第一像素电极与第一栅极线之间或位于第二像素电极与第二栅极线之间。
  • 像素结构主动阵列液晶显示面板
  • [发明专利]像素阵列-CN200910252933.9有效
  • 江博仁;刘晋炜 - 友达光电股份有限公司
  • 2009-12-04 - 2010-06-02 - G02F1/1362
  • 一种像素阵列,包括多个像素列及多条数据线。每一像素列包括一第一扫描线、一第二扫描线、多个第一子像素以及多个第二子像素。第一与第二子像素交替排列于第一与第二扫描线之间。数据线与第一及第二扫描线交错,其中与同一条数据线电性连接的部分第一子像素以及部分第二子像素分别位于该条数据线的两对侧。在第n像素列中,每一第一子像素与第一扫描线的耦合电容为C1。每一第一子像素与第二扫描线的耦合电容为C2。每一第二子像素与第二扫描线的耦合电容为C2’。每一第二子像素与第(n+1)像素列中的第一扫描线的耦合电容为C1’,且(C1+C2)实质上等于(C1’+C2’)。
  • 像素阵列
  • [发明专利]移位缓存器电路-CN200910209175.2有效
  • 刘晋炜;吴威宪;陈静茹 - 友达光电股份有限公司
  • 2009-10-28 - 2010-03-17 - G11C19/28
  • 本发明公开一种移位缓存器电路,该移位缓存器电路包含多级移位缓存器以提供多个栅极信号至多条栅极线。每一级移位缓存器包含上拉单元、用来接收输入信号的输入单元、用来根据输入信号提供驱动控制电压的储能单元、放电单元、耦合单元以及下拉单元。上拉单元根据驱动控制电压以上拉第一栅极信号。放电单元用来执行放电动作以下拉驱动控制电压。耦合单元用来耦合储能单元与后级移位缓存器,使后级移位缓存器所产生的第二栅极信号的下降沿可据以下拉驱动控制电压。下拉单元根据第二栅极信号以下拉第一栅极信号。
  • 移位缓存电路
  • [发明专利]移位暂存器及其移位暂存装置-CN200710106332.8有效
  • 刘晋炜;戴亚翔 - 中华映管股份有限公司
  • 2007-05-15 - 2008-11-19 - G11C19/00
  • 本发明公开了一种移位暂存器及其移位暂存装置。此移位暂存器包括多个移位暂存装置,每一移位暂存装置包括预充电电路、上拉电路、下拉电路。预充电电路用以分别依据第一时脉信号与第二时脉信号取样输入信号,以分别产生第一充电信号与第二充电信号。上拉电路耦接预充电电路,用以接收第三时脉信号与第一充电信号,据以输出输出信号。下拉电路耦接预充电电路与上拉电路,用以接收第四时脉信号与第二充电信号,据以决定是否将输出信号耦接至共同电位。本发明可避免非晶硅薄膜晶体管的栅极长时间受偏压而造成非晶硅薄膜劣化,提升非晶硅薄膜晶体管的可靠度,进而增加整体电路的稳定度。
  • 移位暂存器及其暂存装置

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