专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种基于MPICH+OPENMP的国产化并行计算架构和方法-CN202210312276.8有效
  • 赵漫菲;储一光;王浩枫 - 北京计算机技术及应用研究所
  • 2022-03-28 - 2023-06-09 - G06F9/50
  • 本发明涉及一种基于MPICH+OPENMP的国产化并行计算架构和方法,属于并行计算领域。本发明基于MPICH+OpenMP混合架构构建,通过实现对于计算算法的混合并行加速达到提高计算效率的效果。基于MPICH并行架构的粗粒并行实现节点间的并行计算,包含节点间的任务分发,数据汇集同步等功能。基于OpenMP并行架构的细粒并行计算实现节点内部CPU核之间的算法层面的并行计算。并行加速平台可灵活应用于飞腾、龙芯等国产硬件平台,中标麒麟、银河麒麟等国产操作系统。本发明可以根据并行计算节点系统资源自动调整并行线程数量实现分配并行线程实现算力的最大化利用,相比传统MPI并行拥有更好的稳定性与灵活性,同时弥补了OpenMP只支持单一计算节点的缺点。
  • 一种基于mpichopenmp国产化并行计算架构方法
  • [发明专利]一种LAC中稀疏多项式乘法加速器的FPGA实现方法-CN202110520678.2在审
  • 刘哲;张吉鹏 - 南京航空航天大学
  • 2021-05-13 - 2021-08-13 - G06F7/53
  • 本发明公开了一种LAC中稀疏多项式乘法加速器的FPGA实现方法,自底向上包括4个层次:并行设计层、模约简层、流水线设计层以及可伸缩架构设计层,并行设计层采用内外层循环双并行的技术以实现更高效的并行设计架构;模约简层基于格基密码LAC方案模数251的数学特征,设计了新的硬件友好型模约简算法;流水线设计层对流水线进行更细致的划分以提高加速器运行频率;可伸缩架构设计层采用参数p来控制加速器的并行度以实现可伸缩的加速器架构设计,p越大所使用的硬件资源越多、并行度越高,同理p越小所使用的硬件资源越少、并行度越低。本发明的一种LAC中稀疏多项式乘法加速器的FPGA实现方法并行度更高、工作频率更高、不同场景中的适用性更强。
  • 一种lac稀疏多项式乘法加速器fpga实现方法
  • [发明专利]信号处理并行计算软件的动态重配置方法-CN201210450556.1有效
  • 蔡志明;王希敏;幸高翔;姜可宇;周航;游波 - 中国人民解放军海军工程大学
  • 2012-11-12 - 2013-02-13 - G06F9/50
  • 本发明公开了一种信号处理并行计算软件的动态重配置方法,其包括两个步骤:首先是软件架构图配置与生成,通过计算任务图与并行处理系统硬件特征模型的最优匹配,生成软件架构图;然后是软件架构图分布,针对实际处理器数量与拓扑结构,将配置好的软件架构图分布到实际并行处理系统的各个处理器上。并行处理系统硬件特征包括处理器的内部层次结构和存储结构、处理器计算性能、以及处理器之间通信网络的通信带宽。与现有技术相比,本发明的信号处理并行计算软件重配置方法,是在系统执行时动态分布计算任务到多核处理器,以实现自适应变粒度并行计算,因而,能够实现在线的计算弹性。
  • 信号处理并行计算软件动态配置方法
  • [发明专利]一种基于OpenCL的高速并行化FPGA设计-CN202111358323.4在审
  • 沙金;于浩 - 南京大学
  • 2021-11-16 - 2023-05-19 - G06F9/30
  • 本发明公开了一种基于OpenCL的高速并行化FPGA设计架构,针对雷达信号处理领域数据量大、实时性要求高的特点,提出了一套完整的支持多种并行优化方式的CPU+FPGA异构加速方案。本方案对于常用的并行优化方式如流水线并行、多通道并行优化、循环迭代进行优化设计,并提供了全局内存、本地内存、内核间直传三种访存机制改善了并行化计算过程中数据传输效率的问题。本发明所提出的架构实现了相关的雷达算法包括二维FFT计算和特显点计算,与优化前的效率进行对比,给出分析结果,证明了提出的架构可以满足大部分并行处理的数据传输需求。
  • 一种基于opencl高速并行fpga设计

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