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[发明专利]信息处理设备、信息处理方法、半导体器件及计算机程序-CN200510133807.3无效
发明人：菅原彰彦 -专利权人：索尼计算机娱乐公司
申请日： 2005-12-21 - 公布日： 2006-06-28 - 主分类号： G06F9/38 文献下载
摘要：为提供通过使用具有编译方法仿真所需的性能的处理器来实现解释器方法仿真的信息处理设备，使用一种信息处理设备，其中包含主处理器(1)，用于执行预定处理，及协处理器(2)，用于根据主处理器(1)的指示执行仿真在主处理器(1)指示仿真的执行时，协处理器(2)确定要基于仿真而执行的处理是否可由协处理器(2)执行。当处理可以通过协处理器(2)执行时，协处理器(2)执行处理，但是当处理不可以被执行时，留给主处理器(1)执行处理。
信息处理设备方法半导体器件计算机程序

[发明专利]任务执行系统-CN200480042521.8有效
发明人：阿部睦 -专利权人：丰田自动车株式会社
申请日： 2004-11-12 - 公布日： 2007-03-07 - 主分类号： G06F9/50 文献下载
摘要：一种包括至少两个处理器的任务执行系统，其具有：任务管理表，在该表中注册有在至少任务、用于执行该任务的主执行处理器以及用于当所述主执行处理器停止时执行该任务的停止时负责处理器之间的相关关系，用于从在所述任务管理表中注册的任务中选择可执行的任务的装置，用于如果试图执行所述选择的任务的所述处理器之外的处理器被注册为所述选择的任务的主执行处理器，检查被注册为所述主执行处理器的所述处理器的停止状态的装置，以及，用于如果被注册为所述主执行处理器的所述处理器保持停止，执行所述选择的任务的装置。
任务执行系统

[发明专利]操作一异质性电脑系统的方法-CN201110408300.X无效
发明人：张登章 -专利权人：财团法人资讯工业策进会
申请日： 2011-11-29 - 公布日： 2012-12-12 - 主分类号： G06F1/32 文献下载
摘要：一种操作一异质性电脑系统以执行一电脑软件的任务的方法。该异质性电脑系统具有一高性能处理器、一处理器支援逻辑单元及一虚拟处理器。该方法(i)只启动该虚拟处理器；或(ii)于启动该虚拟处理器后，启动该高性能处理器；或(iii)只启动该高性能处理器；或(iv)于启动该高性能处理器后，启动该虚拟处理器。该虚拟处理器执行其有足够电力执行的任务，并使该高性能处理器处于一省电状态。该虚拟处理器使该高性能处理器脱离该省电状态并执行该虚拟处理器未具足够电力执行的任务。该高性能处理器与该虚拟处理器同步地执行需要全部处理器的电力执行的任务。
操作一异质性电脑系统方法

[发明专利]上下文保存-CN02105102.X无效
发明人：罗伯特·A·惠顿 -专利权人：斯罗扬有限公司
申请日： 2002-02-20 - 公布日： 2002-12-11 - 主分类号： G06F9/38 文献下载
摘要：公开了可在第一执行模式(诸如标量模式)和第二处执行模式(诸如VLIW模式)之间切换的一种处理器。该处理器当处于第一执行模式时具有第一处理器上下文,当处于第二执行模式时具有不同于第一处理器上下文的第二处理器上下文。当处理器试图从一个执行模式改变到另一执行模式时,处理器产生一异常。当处理器切换到第一执行模式的执行线程时,或者当处理器切换到原来是第二执行模式的最后线程的执行线程时,只保存第一处理器上下文。该处理器可这样配置,使得在任何一时间可能处于第二执行模式的线程数小于任何一时间在处理器上可能活动的线程总数。
上下文保存

[发明专利]异质性电脑系统-CN201110408343.8无效
发明人：张登章 -专利权人：财团法人资讯工业策进会
申请日： 2011-11-29 - 公布日： 2012-12-12 - 主分类号： G06F1/16 文献下载
摘要：一种异质性电脑系统，用以执行一电脑软件的任务。该异质性电脑系统具有至少一高性能处理器、一支援该至少一高性能处理器执行该电脑软件任务的处理器支援逻辑单元及一较该至少一高性能处理器省电的虚拟处理器。该虚拟处理器在该处理器支援逻辑单元的支援下，执行该虚拟处理器具有足够电力执行的那些任务，并使该至少一高性能处理器处于一省电状态。该虚拟处理器使该至少一高性能处理器脱离该省电状态，使之执行该虚拟处理器未具足够电力执行的那些任务。该至少一高性能处理器与该虚拟处理器同步地执行需要全部处理器的电力执行的那些任务。
异质性电脑系统

[发明专利]算子计算方法、装置、设备及介质-CN202310029566.6在审
发明人：刘昱泽;赵越;王哲;赵璐 -专利权人：中科驭数（北京）科技有限公司
申请日： 2023-01-09 - 公布日： 2023-05-23 - 主分类号： G06F9/50 文献下载
摘要：其中，算子计算方法包括：获取目标语句；将目标语句在中央处理器上进行处理得到与目标语句对应的至少一个中央处理器可执行算子；针对至少一个中央处理器可执行算子中的每一个中央处理器可执行算子，基于预设代码将中央处理器可执行算子替换成数据处理器可执行算子；在基于核处理器架构的数据处理器上对数据处理器可执行算子进行计算，将计算结果返回至中央处理器，由此，能够将原本由中央处理器进行计算的可执行算子交由基于核处理器架构的数据处理器来执行，减轻了中央处理器的计算压力，同时提升了可执行算子的计算速率。
算子计算方法装置设备介质

[发明专利]纠正软错误的固件机制-CN200910132513.7无效
发明人： N·T·夸克 -专利权人：英特尔公司
申请日： 2000-10-04 - 公布日： 2009-09-23 - 主分类号： G06F11/16 文献下载
摘要：本发明提供一种计算机系统，包括有双执行核心的处理器和存储错误恢复程序的非易失性存储器。当处理器处于冗余执行模式时处理器的执行核心以锁定步骤操作，当处理器处于分离执行模式时它们独立地操作。当处理器在以冗余执行模式执行的同时检测到软错误时错误恢复程序被调用。错误恢复程序切换处理器到分离执行模式。在分离模式下，每个执行核心保存未损坏的处理器状态数据到指定的存储单元并用来自另一个执行核心的相应的处理器状态数据更新任何已损坏的数据。错误恢复程序返回处理器到冗余模式，用恢复的处理器状态数据初始化每个执行核心，并返回处理器的控制到检测到软错误时正在执行的程序线程。
纠正错误机制

[发明专利]纠正软错误的固件机制-CN00819142.5无效
发明人： N·T·夸克 -专利权人：英特尔公司
申请日： 2000-10-04 - 公布日： 2003-08-06 - 主分类号： G06F11/16 文献下载
摘要：一种计算机系统，包括有双执行核心的处理器和存储错误恢复例行程序的非易失性存储器。当处理器处于冗余执行模式时处理器的执行核心以固定的方式操作，当处理器处于分离执行模式时它们独立地操作。当处理器在以冗余执行模式执行的同时检测软错误时错误恢复例行程序被调用。错误恢复例行程序转换处理器到分离执行模式。在分离模式中，每个执行核心保存未损坏的处理器状态数据到指定的存储单元并用来自另一个执行核心的相应的处理器状态数据更新任何已损坏的数据。错误恢复例行程序返回处理器到冗余模式，用恢复的处理器状态数据初始化每个执行核心，并返回处理器的控制到检测到软错误时正在执行的程序线程。
纠正错误机制

[发明专利]操作处理器的方法、处理器、电子装置和存储介质-CN202310637891.0在审
发明人：曹鎏 -专利权人：北京奕斯伟计算技术股份有限公司
申请日： 2023-05-31 - 公布日： 2023-08-25 - 主分类号： G06F21/53 文献下载
摘要：本公开的至少一实施例提供了操作处理器的方法、处理器、电子装置和存储介质。该操作处理器的方法包括：在处理器的控制状态寄存器中记录处理器的当前运行执行域的执行域状态信息；以及在处理器处理当前运行执行域的事务的过程中，至少在处理器的部分流水线中传输执行域状态信息。该操作处理器的方法可以促进基于执行域状态信息构建例如CPU、SOC等级别的安全执行域。
操作处理器方法电子装置存储介质

[发明专利]以辅助处理器预取用于主要处理器的指令的方法和装置-CN01816274.6有效
发明人： S·乔杜里;M·特伦布莱 -专利权人：太阳微系统公司
申请日： 2001-08-30 - 公布日： 2004-01-07 - 主分类号： G06F9/38 文献下载
摘要：本发明的一个实施例提供了一种系统，其通过使用一个辅助处理器在一个主要处理器之前执行预取操作来预取指令。通过在该主要处理器上执行可执行代码且同时在该辅助处理器上执行一个简化版本的可执行代码来操作该系统。这个简化版本的可执行代码比该可执行代码执行更加迅速，并且在该主要处理器需要该指令之前，为该主要处理器执行预取操作。在本发明的一个实施例中，在执行该可执行代码之前，该系统编译源代码为用于该主要处理器的可执行代码。然后，该系统对该可执行代码进行程序概要分析以产生该可执行代码频繁涉及部分的指令追踪。然后，该系统通过产生预取指令而将该指令追踪部分预取到一个该主要处理器可访问的高速缓存中，产生用于该辅助处理器的可执行代码的简化版本。该系统也插入通信指令到用于主要处理器的该可执行代码和用于辅助处理器的可执行代码的简化版本中，以从该主要处理器传送进展信息给该辅助处理器。这个进展信息触发该辅助处理器执行预取操作。
辅助处理器用于主要指令方法装置

[发明专利]使用指令追踪或标出的处理器仿真-CN200980134122.7有效
发明人： A·D·沃克 -专利权人：爱立信电话股份有限公司
申请日： 2009-08-24 - 公布日： 2011-07-20 - 主分类号： G06F17/50 文献下载
摘要：一种有效的周期准确的处理器执行仿真器通过执行借助于在与目标处理器兼容的现有处理器上的执行解决了运行时间相关性的、包括指令的程序执行映像来为目标处理器建模。指令可能已在太复杂而不能建模的I/O环境中的处理器上执行。在一个实施例中，仿真器执行以前直接在处理器上执行的指令。在另一实施例中，标出引擎通过参照在处理器上执行的指令，改变编译的程序映像以消除运行时间相关性。标出程序映像随后由仿真器执行。处理器执行仿真器包括可操作用于周期准确地仿真指令执行的更新引擎和可操作用于为目标处理器的每个通信总线建模的通信引擎。
使用指令追踪标出处理器仿真

[发明专利]视频数据处理方法及装置-CN97122731.4无效
发明人：克利夫·里德;孙在澈;阿姆贾德·库里什;利·T·恩格延;马克·福雷德里克森;蒂姆·陆 -专利权人：三星电子株式会社
申请日： 1997-08-19 - 公布日： 2004-04-07 - 主分类号： H04N7/28 文献下载
摘要：一种计算机系统，包括能同时工作的三个处理器：标量处理器、矢量处理器和位流处理器；在视频数据编码或译码中，矢量处理器执行单指令多数据处理器能有效执行的操作，如DCT和运动补偿；位流处理器执行哈夫曼和RLC编码或译码；位流处理器能切换现场以使计算机系统同时处理多个数据流；标量和矢量处理器能被编程执行单个算术或布尔指令；位流处理器不能被编程执行单个算术或布尔指令，但是能被编程执行整个视频数据处理操作。
视频数据处理方法装置

[发明专利]视频数据处理方法及装置-CN200410005016.8无效
发明人：克利夫·里德;孙在澈;阿姆贾德·库里什;利·T·恩格延;马克·福雷德里克森;蒂姆·陆 -专利权人：三星电子株式会社
申请日： 1997-08-19 - 公布日： 2004-08-25 - 主分类号： H04N7/28 文献下载
摘要：一种计算机系统，包括能同时工作的三个处理器：标量处理器、矢量处理器和位流处理器；在视频数据编码或译码中，矢量处理器执行单指令多数据处理器能有效执行的操作，如DCT和运动补偿；位流处理器执行哈夫曼和RLC编码或译码；位流处理器能切换现场以使计算机系统同时处理多个数据流；标量和矢量处理器能被编程执行单个算术或布尔指令；位流处理器不能被编程执行单个算术或布尔指令，但是能被编程执行整个视频数据处理操作。
视频数据处理方法装置

[发明专利]利用处理器缓存和安全处理器改进系统安全性的技术方案-CN201911278191.7有效
发明人：买宇飞;应志伟;杜朝晖 -专利权人：海光信息技术股份有限公司
申请日： 2019-12-12 - 公布日： 2023-10-20 - 主分类号： G06F3/06 文献下载
摘要：一种对处理器缓存进行控制的安全处理器，其特征在于，所述安全处理器对处理器缓存进行控制，将处理器缓存划分为可信执行环境与普通执行环境，其中，可信执行环境运行要求安全级别高的进程，普通执行环境运行普通的进程，普通的进程不能使用可信执行环境。本公开利用安全处理器控制缓存配置，为可信计算环境执行的代码分配专用的处理器缓存，提高了执行环境的安全性。
利用处理器缓存安全改进系统安全性技术方案

[发明专利]运算指令处理方法及系统、主处理器和协处理器-CN202111396203.3在审
发明人：陈东坡;袁博浒;董卫民 -专利权人：广东跃昉科技有限公司
申请日： 2021-11-23 - 公布日： 2023-05-23 - 主分类号： G06F7/552 文献下载
摘要：运算处理方法及系统、主处理器和协处理器，所述方法包括：主处理器首先获取待处理的运算指令，并判断所述运算指令是否为协处理器运算指令；当确定所述运算指令为协处理器运算指令时，所述主处理器将所述运算指令发送至协处理器，以使得所述协处理器执行所述运算指令，并获取所述协处理器发送的所述运算指令的执行结果。上述的方案，通过将协处理器运算指令发送至协处理器执行，以减少处理器的取指次数，提高主处理器的执行效率。
运算指令处理方法系统处理器和协

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