[发明专利]基于SoC FPGA的RISC-V硬件测试方法及系统在审
| 申请号： | 202210145663.7 | 申请日： | 2022-02-17 |
| 公开（公告）号： | CN114528174A | 公开（公告）日： | 2022-05-24 |
| 发明（设计）人： | 彭诗翰;赵釜;游义全;万毅;田亮 | 申请（专利权）人： | 重庆海云捷迅科技有限公司 |
| 主分类号： | G06F11/263 | 分类号： | G06F11/263;G06F11/22;G06F13/38 |
| 代理公司： | 成都九鼎天元知识产权代理有限公司 51214 | 代理人： | 罗强 |
| 地址： | 404100 重庆市沙坪坝区*** | 国省代码： | 重庆;50 |
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| 摘要： | 本发明提供了一种基于SoC FPGA的RISC‑V硬件测试方法，包括：步骤1、将RISC‑V处理器配置在FPGA，并完成与HPS的总线互连；步骤2、HPS向RISC‑V处理器发送复位信号，RISC‑V处理器启动；步骤3、RISC‑V处理器向HPS发送访问存储以及外设控制信号，对内存和外设控制器进行访问；步骤4、HPS将访问外设控制器产生的数据通过串口打印，完成RISC‑V测试。本发明提出的方案使用便利且可适配多种RISC‑V处理器，节省了用户大量去熟悉各个厂商提供的硬件测试环境和平台，或者为了测试和验证RISC‑V处理器功能而去搭建设计单独的硬件测试平台的时间。 | ||
| 搜索关键词： | 基于 soc fpga risc 硬件 测试 方法 系统 | ||
【主权项】：
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