[实用新型]一种宽带捷变频频率合成器有效

专利信息
申请号: 201521086298.9 申请日: 2015-12-24
公开(公告)号: CN205212817U 公开(公告)日: 2016-05-04
发明(设计)人: 李犟;胡丽格 申请(专利权)人: 中国电子科技集团公司第五十四研究所
主分类号: H03L7/18 分类号: H03L7/18
代理公司: 河北东尚律师事务所 13124 代理人: 王文庆
地址: 050081 河北省石家*** 国省代码: 河北;13
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摘要: 实用新型公开了一种宽带捷变频频率合成器,它涉及通信领域中本振源的频率合成器。它由倍频器、滤波器、跳频锁相环电路、放大器、开关、FPGA等部件组成。它通过串行接口进行频率控制,内部由跳频锁相环电路、开关及滤波器实现频率合成目的。本实用新型具有输出步进小、快速跳频、相位噪声低、杂散低、谐波低、频率范围宽、集成化程度高、功耗低、结构简单、性能稳定可靠等优点,能够在较恶劣环境下正常工作,特别适用于作为抗干扰卫星通信设备的本振源。
搜索关键词: 一种 宽带 变频 频率 合成器
【主权项】:
一种宽带捷变频频率合成器,包括倍频器(1)、功分器(2)、FPGA(5)、第一开关(6)、第二开关(7)、第一滤波器(8)、第二滤波器(9)、第三开关(10)和放大器(11);其特征在于,还包括第一跳频锁相环电路(3)和第二跳频锁相环电路(4);所述的第一跳频锁相环电路(3)和第二跳频锁相环电路(4)集成了锁相环和VCO;其中倍频器(1)的输入端口与外部相连接,倍频器(1)的输出端口与功分器(2)的输入端口相连接;功分器(2)的输出端口分别与第一跳频锁相环电路(3)和第二跳频锁相环电路(4)的输入端口相连接;FPGA(5)的输出端口分别与第一跳频锁相环电路(3)和第二跳频锁相环电路(4)的输入端口相连接;第一跳频锁相环电路(3)和第二跳频锁相环电路(4)的输出端口均与第一开关(6)相连接;第一开关(6)的输出端口与第二开关(7)的输入端口相连接;第二开关(7)的输出端口分别与第一滤波器(8)和第二滤波器(9)的输入端口相连接;第一滤波器(8)和第二滤波器(9)的输出端口均与开关(10)相连接;开关(10)的输出端口与放大器(11)的输入端口相连接;放大器(11)与外部相连接。
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