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专利名称

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申请人
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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]基于功能亲和度分组的配置状态寄存器-CN201880073154.X有效
发明人： M·K·克施温德;V·萨拉普拉 -专利权人：国际商业机器公司
申请日： 2018-11-02 - 公布日： 2023-09-05 - 主分类号： G11C8/00 文献下载
摘要：基于功能亲和度分组的配置状态寄存器。获得针对其分配了存储器的存储器内配置状态寄存器的标识。基于该标识，确定到存储器的偏移，该存储器内配置状态寄存器被存储在该偏移处。偏移是基于存储器内配置状态寄存器的功能亲和度而被分配给存储器内配置状态寄存器的。至少使用该偏移来访问存储器内配置状态寄存器。
基于功能亲和分组配置状态寄存器

[发明专利]存储器地址管理技术-CN202211384279.9在审
发明人： D·Y·卡奥 -专利权人：美光科技公司
申请日： 2022-11-07 - 公布日： 2023-05-12 - 主分类号： G11C8/00 文献下载
摘要：本申请案涉及存储器地址管理技术。一种主机系统可传输用以将数据存储在存储器系统处的写入命令而不将例如逻辑地址的地址传输到所述存储器系统。在一些实例中，所述存储器系统可使用指示所述存储器系统的可用位置的起始地址的一或多个指针为所述数据产生物理地址。所述存储器系统可传输所述所产生地址的指示，例如所述物理地址、对应逻辑地址或选定指针的指示。在一些情况下，产生所述地址与存储所述数据可在时间上至少部分地重叠。
存储器地址管理技术

[发明专利]具有输入/输出数据速率对齐的存储器部件-CN201780035329.3有效
发明人： F·A·韦尔;J·E·林斯塔特;T·帕尔奇 -专利权人：拉姆伯斯公司
申请日： 2017-07-07 - 公布日： 2023-04-28 - 主分类号： G11C8/00 文献下载
摘要：在由核心存储阵列的数据输出带宽所约束的第一时间间隔上从存储器部件的核心存储阵列中读取第一数据。在从核心存储阵列中读取之后，在比第一时间间隔更短、并且与比核心存储阵列的数据输出带宽更大的数据传输带宽相对应的第二时间间隔之上从存储器部件输出该第一数据。
具有输入输出数据速率对齐存储器部件

[发明专利]闪存存储器的操作方法及装置-CN202211552294.X在审
发明人：张黄鹏 -专利权人：长江存储科技有限责任公司
申请日： 2021-01-25 - 公布日： 2023-03-14 - 主分类号： G11C8/00 文献下载
摘要：本发明提供了一种闪存存储器的操作方法及装置，操作方法包括：在对所述闪存存储器进行数据操作时，向所述闪存存储器写入操作命令；所述操作命令至少包括地址信息；所述地址信息包括数据地址和补偿特征值；所述闪存存储器包括外围电路和存储单元阵列；所述外围电路根据所述补偿特征值调节数据操作参数并对所述存储单元阵列中所述数据地址处的数据执行所述数据操作。本发明在对闪存存储器进行数据操作时，将补偿特征值设置于地址信息中，无需额外引入特征值设置序列，从而大幅节省了闪存存储器数据操作时间，提升了器件性能。
闪存存储器操作方法装置

[发明专利]闪存存储器的操作方法及装置-CN202110093103.7有效
发明人：张黄鹏 -专利权人：长江存储科技有限责任公司
申请日： 2021-01-25 - 公布日： 2023-01-17 - 主分类号： G11C8/00 文献下载
摘要：本发明提供了一种闪存存储器的操作方法及装置，操作方法的特征在于：在对所述闪存存储器进行数据操作时，向所述闪存存储器写入操作命令；所述操作命令至少包括地址信息；所述地址信息包括数据地址和补偿特征值；所述闪存存储器包括外围电路和存储单元阵列；所述外围电路根据所述补偿特征值调节数据操作参数并对所述存储单元阵列中所述数据地址处的数据执行所述数据操作。本发明在对闪存存储器进行数据操作时，将补偿特征值设置于地址信息中，无需额外引入特征值设置序列，从而大幅节省了闪存存储器数据操作时间，提升了器件性能。
闪存存储器操作方法装置

[发明专利]全耗尽型绝缘体上硅闪存存储器设计-CN201680059275.X有效
发明人： H.V.陈;A.李;T.武;H.Q.阮 -专利权人：硅存储技术公司
申请日： 2016-09-14 - 公布日： 2021-09-07 - 主分类号： G11C8/00 文献下载
摘要：本发明涉及一种闪存存储器系统，其中一个或多个电路区块利用全耗尽型绝缘体上硅晶体管设计来使泄漏最小化。
耗尽绝缘体闪存存储器设计

[发明专利]目标行刷新方法及存储器装置中所采用的决策电路-CN202011460400.2在审
发明人：赖亚群;吴柏勋;许人寿 -专利权人：晶豪科技股份有限公司
申请日： 2020-12-11 - 公布日： 2021-08-06 - 主分类号： G11C8/00 文献下载
摘要：一种目标行刷新方法包括：提供第一先进先出缓冲器作为具有M个条目的第一数据表，第一数据表的每一条目能够储存目标行地址的信息；提供第二先进先出缓冲器作为具有K个条目的第二数据表，分别能够储存相同或不同的候选行地址；输入地址寄存器以接收输入地址；判断输入地址寄存器中的输入地址是否符合第一数据表中所记录的地址信息；当不符合时，根据采样策略使用输入地址来决定是否更新目标行锁存器的信息，以决定是否对比输入地址与第二数据表中所记录的地址数据来决定目标行地址；以及执行目标行刷新操作以刷新一个或多个行。
目标刷新方法存储器装置采用决策电路

[发明专利]具有非均匀刷新的存储器设备-CN201980015322.4在审
发明人： T·沃吉尔桑 -专利权人：拉姆伯斯公司
申请日： 2019-06-25 - 公布日： 2020-10-20 - 主分类号： G11C8/00 文献下载
摘要：一种集成电路存储器设备包括：存储单元阵列，被配置成多个存储体。每个存储体包括多个分段。寄存器存储装置存储表示逐分段刷新参数的逐分段值。刷新逻辑根据对应的逐分段值来刷新每个分段。
具有均匀刷新存储器设备

[发明专利]一种地址匹配电路-CN201610646134.X有效
发明人：王礼维 -专利权人：武汉新芯集成电路制造有限公司
申请日： 2016-08-09 - 公布日： 2019-05-28 - 主分类号： G11C8/00 文献下载
摘要：本发明涉及存储器地址侦测领域，尤其涉及应用于大容量存储器的一种地址匹配电路，包括一预充电电路、若干个比较电路以及并联的若干个放电电路；所述预充电电路的输出端连接至一匹配信号；每个所述比较电路的输出端分别连接至一放电电路的输入端；每个所述放电电路的输出端并联连接至所述匹配信号。本发明的地址匹配电路使用传输门和反相器组成基本的同或/异或单元，面积小、功耗低，地址匹配速度高，并且使用预充电和并行放电机制，实现大容量地址匹配结果输出。
一种地址匹配电路

[发明专利]地址检测电路和包括其的存储器件-CN201410437498.8有效
发明人：池性洙;许咏植 -专利权人：爱思开海力士有限公司
申请日： 2014-08-29 - 公布日： 2019-03-26 - 主分类号： G11C8/00 文献下载
摘要：一种地址检测电路可以包括：一个或多个地址储存单元；初始化单元，适于删除具有大于N的值的储存在地址储存单元中的地址，其中，所述值通过将相应的地址被储存之后地址已经被输入的相应的总输入次数除以与储存的地址相对应的相应的输入次数来获得；检测单元，适于从储存在一个或多个地址储存单元中的地址中检测输入次数为参考次数或更多次的地址；以及选择单元，适于选择未储存地址的地址储存单元，并且将输入地址储存在选中的地址储存单元中。
地址检测电路包括存储器件

[发明专利]用于使用延迟锁相回路的记忆体装置的节能设备及方法-CN201380040574.5有效
发明人： Q·哈桑;C·兹特劳;S·罗斯内;S·迪布瓦 -专利权人：赛普拉斯半导体公司
申请日： 2013-07-31 - 公布日： 2018-06-01 - 主分类号： G11C8/00 文献下载
摘要：实施例是指透过同步时脉信号在高频率用于记忆体数据传输时减少耗电量。延迟锁相回路(DLL)电路是用于产生该同步时脉信号。DLL电路只要正在输出该同步时脉信号即消耗电量。描述节能装置及方法，其中，当记忆体数据存取活跃时启动该DLL电路，而当记忆体存取闲置时该DLL电路被关闭。
时脉信号电路延迟锁相回路记忆体记忆体存取记忆体装置方法实施节能设备节能装置数据传输数据存取消耗电量高频率耗电量闲置输出

[发明专利]存储控制器中的存储仿真-CN201680028889.1在审
发明人： T·R·埃尔哈特 -专利权人：波利伍德有限责任公司
申请日： 2016-03-21 - 公布日： 2018-01-26 - 主分类号： G11C8/00 文献下载
摘要：提供一种操作存储控制器的方法。所述方法包括从主机接收第一主机数据业务，用于存储在存储系统内的第一分区中，第一主机数据业务被格式化用于存储在第一类型的数据存储器中，以及将第一主机数据业务转换为存储数据，该存储数据被格式化用于存储在第二类型的数据存储器中。该方法还包括将存储数据存储在第一分区中，通过主机接口从主机接收读取请求，并且检索来自第一分区的存储数据的一些或全部。该方法还包括将存储数据的一些或全部格式化为与第一主机数据业务兼容的格式，并且以与第一类型的数据存储器相对应的配置将格式化的数据传输到主机。
存储控制器中的仿真

[发明专利]存储控制器中的可配置多级纠错-CN201680028940.9在审
发明人： T·R·埃尔哈特 -专利权人：波利伍德有限责任公司
申请日： 2016-03-20 - 公布日： 2018-01-19 - 主分类号： G11C8/00 文献下载
摘要：一种操作存储控制器的方法，包括(a)从主机接收主机数据，用于存储在存储系统中的分区内，和(b)基于至少一个分区参数确定纠错代码级别的量。该方法还包括(c)将主机数据划分到多个有效负载中，(d)为有效负载提供元数据，(e)为有效负载和与每个有效负载相关联的元数据计算纠错代码，和(f)创建多个代码字，每个代码字包括有效负载和与有效负载对应的元数据和纠错代码。该方法包括(g)基于纠错代码级别的量，将代码字存储在存储系统中，或将代码字划分到多个进一步的有效负载中，根据步骤(d)至(g)反复地处理所述进一步的有效负载以提供纠错代码级别的量。
存储控制器中的配置多级纠错

[发明专利]具有用于高可靠性操作的存储控制器的数据处理器和方法-CN201480049008.5在审
发明人：凯文·M·布朗德 -专利权人：超威半导体公司
申请日： 2014-10-06 - 公布日： 2016-04-20 - 主分类号： G11C8/00 文献下载
摘要：一种数据处理器包括存储器访问代理和存储控制器。所述存储器访问代理产生到存储器的多个访问。所述存储控制器被耦接到所述存储器访问代理，并基于所述存储器的特性来按顺序安排所述多个存储器访问。所述存储器的所述特性包括行周期页面时间(t_RCPAGE)，所述行周期页面时间(t_RCPAGE)指示在预先确定的时间窗口内对所述存储器中的行的激活命令的可接受的数量。
具有用于可靠性操作存储控制器数据处理器方法

[发明专利]用于媒体处理加速器的采集方法和装置-CN201280036339.6有效
发明人： K·瓦伊蒂亚纳坦;B·G·雷迪 -专利权人：英特尔公司
申请日： 2012-07-23 - 公布日： 2014-04-09 - 主分类号： G11C8/00 文献下载
摘要：描述了装置、系统和方法，包括将高速缓冲存储器线至少划分为最高有效部分和次最高有效部分，将高速缓冲存储器线内容存储在寄存器阵列中，以使得每一个高速缓冲存储器线的最高有效部分存储在寄存器阵列的第一行中且每一个高速缓冲存储器线的次最高有效部分存储在寄存器阵列的第二行中。第一行的第一寄存器部分的内容可以提供给桶形移位器，其中，可以对齐该内容且随后将该内容存储在缓冲器中。
用于媒体处理加速器采集方法装置

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