专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
专利下载VIP
公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
更多 »
专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
更多 »
钻瓜专利网为您找到相关结果48个,建议您升级VIP下载更多相关专利
  • [发明专利]有效比较操作-CN201780028021.6有效
  • D·P·霍夫;S·E·李莱斯;B·J·里德 - 高通股份有限公司
  • 2017-04-07 - 2023-10-13 - G06F12/0895
  • 系统和方法涉及存储器阵列中的存储器操作。使用感测放大器执行比较操作。搜索位的真实和互补版本与存储在所述存储器阵列的数据行中的数据位的真实和互补版本进行比较以产生真实和互补感测放大器输入。所述真实和互补感测放大器输入在所述感测放大器中被放大以产生单端匹配信号。所述单端匹配信号可以与所述数据行中的其它单端匹配信号汇总以确定是否存在用于在所述整个数据行上的比较操作的命中或未命中。
  • 有效比较操作
  • [发明专利]集成闪存的高带宽存储器设备-CN201810070897.3有效
  • 克里希纳·T·马兰迪;郑宏忠 - 三星电子株式会社
  • 2018-01-24 - 2023-07-07 - G06F12/0895
  • 根据本发明的一些实施例,提供了一种用于具有主机处理器的处理设备的混合高速缓存存储器,所述混合高速缓存存储器包括:高带宽存储器(HBM),被配置为存储主机数据;在同一封装中与HBM物理集成的非易失性存储器(NVM),被配置为存储HBM处的主机数据的副本;以及高速缓存控制器,被配置为与主机处理器进行双向通信,并且管理HBM和NVM之间的数据传输,并且响应于从主机处理器接收到的命令来管理混合高速缓存存储器和主机处理器之间的数据传输。
  • 集成闪存带宽存储器设备
  • [发明专利]穿戴设备的数据处理方法、装置、设备及存储介质-CN202310009923.2在审
  • 刘洁;于会泳 - 歌尔股份有限公司
  • 2023-01-04 - 2023-05-09 - G06F12/0895
  • 本发明属于数据处理技术领域,公开了一种穿戴设备的数据处理方法、装置、设备及存储介质。该方法包括:在接收到传感器发送的待缓存数据体时,检测缓存池的缓存状态;在所述缓存池的缓存状态不为预设状态时,将所述待缓存数据体发送至所述缓存池进行缓存;获取所述缓存池中的已缓存数据体,并对所述已缓存数据体进行数据处理。通过上述方式,将穿戴设备上各传感器的数据存入至对应的缓存池,并从缓存池中获取已缓存数据体进行数据处理,避免了直接对传感器的待缓存数据体进行处理时,处理时间较长导致传感器数据丢失,处理精度和处理效率较差的情况。
  • 穿戴设备数据处理方法装置存储介质
  • [发明专利]Cache中地址标记方法、装置、图形处理系统及电子设备-CN202310056066.1有效
  • 王海洋;姜莹 - 北京象帝先计算技术有限公司
  • 2023-01-19 - 2023-04-18 - G06F12/0895
  • 本公开提供一种Cache中地址标记方法、装置、图形处理系统及电子设备,所述Cache的映射方式被配置为组相联,所述Cache中的每一路中的每个缓存行被配置有对应的连续地址标记,任一缓存行对应的连续地址标记用于标记:与该缓存行存在地址连续关系的缓存行所在的路;其中,存在地址连续关系包括:任意两个缓存行对应的主存地址连续;所述方法包括:在对目标缓存行进行更新后,确定更新后的目标缓存行的Tag标记,并获取与目标缓存行所在的目标组相邻的组之中的各缓存行的Tag标记;根据获取的Tag标记,对目标缓存行对应的连续地址标记,和/或,与目标缓存行所在的目标组相邻的组之中的缓存行的连续地址标记进行更新。
  • cache地址标记方法装置图形处理系统电子设备
  • [发明专利]预比对系统及预比对方法-CN201810947713.7有效
  • 赖乙婷;江志和 - 旺宏电子股份有限公司
  • 2018-08-20 - 2023-04-14 - G06F12/0895
  • 一种预比对方法包括:接收一初始地址;根据该初始地址而逐渐增加一目前地址;对该目前地址增加一偏差值,以取得一比对地址;比较该比对地址与至少一缺陷地址,以产生一命中参数;产生相关于该比对地址的一冗余地址;以及依据该命中参数设定一Y方向地址为该目前地址或该冗余地址,该Y方向地址相关于对该存储器阵列的存取。
  • 系统方法
  • [发明专利]缓存设计管理方法、装置、设备和计算机可读存储介质-CN202110078009.4有效
  • 许晓强 - 网易(杭州)网络有限公司
  • 2021-01-20 - 2023-03-21 - G06F12/0895
  • 本申请涉及计算机网络领域,提供了缓存设计管理方法、装置、设备和计算机可读存储介质,以对出现问题的缓存精确定位,避免中心节点崩溃带来的系统整体坍塌。所述方法包括:基于选定的函数,将多个缓存中任意一个缓存的标识BID映射为目标应用进程的进程号;按照预设周期,获取根据目标应用进程的进程号创建至目标应用进程上各个缓存的在线状况;根据目标应用进程上各个缓存的在线状况,基于缓存淘汰算法对创建至目标应用进程上的缓存进行管理。本申请的技术方案一方面可以按照映射关系迅速定位到出现问题的缓存所在的应用进程,另一方面可以避免现有技术那样一个中心节点崩溃导致整个系统坍塌的风险。
  • 缓存设计管理方法装置设备计算机可读存储介质
  • [发明专利]一种用于并行数据存储的超导高速缓冲存储器-CN201811156556.4有效
  • 许婉宁;任洁;应利良;王镇 - 中国科学院上海微系统与信息技术研究所
  • 2018-09-30 - 2022-12-23 - G06F12/0895
  • 本发明提供一种用于并行数据存储的超导高速缓冲存储器,包括M个并行的N位存储单元,用于存储N位数据,并在清除操作期间,基于清除控制信号清除指定清除位的数据;在写入操作期间,基于写入控制信号将输入数据写入指定写入位;清除写入地址译码器,连接N位存储单元,用于在清除操作期间产生清除控制信号,在写入操作期间产生输入、写入控制信号;数据输入缓冲门,连接清除写入地址译码器和N位存储单元,基于输入控制信号,将暂存的输入数据输出至N位存储单元;数据输出地址译码器,用于在读出操作期间产生读出控制信号;数据输出控制门,连接数据输出地址译码器和N位存储单元,用于在读出操作期间,基于读出控制信号读出指定读出位的数据。
  • 一种用于并行数据存储超导高速缓冲存储器
  • [发明专利]基于SOA架构的车辆数据采集系统、方法、设备及介质-CN202210912533.1在审
  • 谢磊 - 重庆长安汽车股份有限公司
  • 2022-07-30 - 2022-10-18 - G06F12/0895
  • 本申请提供一种基于SOA架构的车辆数据采集系统、方法、设备及介质,该系统包括:数据抽象模块,用于获取车辆的感知数据,对感知数据进行分类;数据缓存模块,基于预设的订阅服务确定订阅主题,根据订阅主题对车辆的图像数据、雷达点云数据与整车信号数据进行匹配,并将匹配结果缓存到缓存队列;事件触发模块,利用预设的事件判断逻辑对事件的触发条件进行判断,若事件满足触发条件,将事件关联的事件信息进行发布;数据处理模块,用于根据事件信息的事件类型确定事件采集时间与采集内容,按照采集时间与采集内容对缓存队列的数据进行采集,本申请根据事件的类型准确采集车辆当前的数据,完整反映事件关联的数据信息。
  • 基于soa架构车辆数据采集系统方法设备介质
  • [发明专利]一种缓存淘汰方法、装置及电子设备-CN202011163795.X有效
  • 刘少荘;张亚东 - 苏州浪潮智能科技有限公司
  • 2020-10-27 - 2022-08-05 - G06F12/0895
  • 本发明提供了一种缓存淘汰方法、装置及电子设备,属于网络设备技术领域,解决了现有的缓存淘汰算法存在缓存命中率低的技术问题。一种缓存淘汰方法,应用于电子设备,其中电子设备的内存中包括第一缓存链表、第二缓存链表、第一历史记录链表和第二历史记录链表,方法包括以下步骤:判断当前访问数据所处的位置;若当前访问数据出现在第一缓存链表中,则将当前访问数据插入第二缓存链表的表头,且从第一缓存链表中删除;若当前访问数据未出现在第一缓存链表中,则判断当前访问数据是否出现在第二缓存链表中;若当前访问数据出现在第二缓存链表中,则将当前访问数据移动到第二缓存链表的表头。
  • 一种缓存淘汰方法装置电子设备

关于我们 寻求报道 投稿须知 广告合作 版权声明 网站地图 友情链接 企业标识 联系我们

钻瓜专利网在线咨询

400-8765-105周一至周五 9:00-18:00

咨询在线客服咨询在线客服
tel code back_top