[发明专利]一种纠错码标准化验证组件及其验证方法在审
| 申请号: | 202310345451.8 | 申请日: | 2023-03-29 |
| 公开(公告)号: | CN116302672A | 公开(公告)日: | 2023-06-23 |
| 发明(设计)人: | 朱峰 | 申请(专利权)人: | 阿里巴巴(中国)有限公司 |
| 主分类号: | G06F11/10 | 分类号: | G06F11/10 |
| 代理公司: | 北京市立康律师事务所 11805 | 代理人: | 许志影 |
| 地址: | 311121 浙江省杭州市余杭*** | 国省代码: | 浙江;33 |
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| 摘要: | |||
| 搜索关键词: | 一种 纠错码 标准化 验证 组件 及其 方法 | ||
1.一种纠错码标准化验证组件,其特征在于,包括:
测试对象;
错误注入模块,用于监测测试对象的行为,并当监测到测试对象在进行RAM的写操作时,将纠错码错误注入到RAM中;
结果预期模块,与所述错误注入模块通讯连接,所述结果预期模块当监测到测试对象发生读RAM操作时,根据从所述错误注入模块接收的错误注入信息,判断此次读RAM操作请求是否会发生纠错码错误以及具体的错误信息,获取预期值,并当测试对象上报错误信息时,将上报的错误信息和预期值进行比较,以判断测试对象上报错误信息行为的正确性;
其中,所述错误注入模块、所述结果预期模块均采用参数化的类设计,且与所述测试对象封装成一独立纠错码标准化验证组件。
2.根据权利要求1所述的纠错码标准化验证组件,其特征在于,所述错误注入模块、所述结果预期模块均通过虚拟接口监测测试对象的行为。
3.根据权利要求1所述的纠错码标准化验证组件,其特征在于,所述错误注入模块以校验粒度为单位进行纠错码错误注入,并控制1bit和2bit错误的注入概率。
4.根据权利要求1所述的纠错码标准化验证组件,其特征在于,所述独立纠错码标准化验证组件支持的参数包括:RAM的数据位宽、RAM的index位宽、RAM的校验粒度和RAM的路数量。
5.根据权利要求4所述的纠错码标准化验证组件,其特征在于,所述独立纠错码标准化验证组件通过调整所述参数以适配不同大小的RAM。
6.一种纠错码标准化验证组件的验证方法,其特征在于,包括:
错误注入步骤,错误注入模块监测测试对象的行为,并当监测到测试对象在进行RAM的写操作时,将纠错码错误注入到RAM中;
结果预期步骤,结果预期模块当监测到测试对象发生读RAM操作时,根据从所述错误注入模块接收的错误注入信息,判断此次读RAM操作请求是否会发生纠错码错误以及具体的错误信息,获取预期值,并当测试对象上报错误信息时,将上报的错误信息和预期值进行比较,以判断测试对象上报错误信息行为的正确性;
其中,所述错误注入模块、所述结果预期模块均采用参数化的类设计,且与所述测试对象封装成一独立纠错码标准化验证组件。
7.根据权利要求6所述的纠错码标准化验证组件的验证方法,其特征在于,所述错误注入模块、所述结果预期模块均通过虚拟接口监测测试对象的行为。
8.根据权利要求6所述的纠错码标准化验证组件的验证方法,其特征在于,所述错误注入步骤中,还包括:
所述错误注入模块以校验粒度为单位进行纠错码错误注入,并控制1bit和2bit错误的注入概率。
9.根据权利要求6所述的纠错码标准化验证组件的验证方法,其特征在于,所述独立纠错码标准化验证组件支持的参数包括:RAM的数据位宽、RAM的index位宽、RAM的校验粒度和RAM的路数量。
10.根据权利要求9所述的纠错码标准化验证组件的验证方法,其特征在于,所述独立纠错码标准化验证组件通过调整所述参数以适配不同大小的RAM。
11.一种计算机设备,其特征在于,包括:
至少一个处理器;以及
存储器,用于存储可在所述处理器上运行的计算机指令,所述计算机指令由所述处理器执行时实现如上权利要求6-10任一项所述的纠错码标准化验证组件的验证方法。
12.一种计算机可读存储介质,所述计算机可读存储介质存储有计算机程序,其特征在于,所述计算机程序被执行时实现如权利要求6-10任一项所述的纠错码标准化验证组件的验证方法。
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