[发明专利]汇流排系统以及其检测方法在审
申请号: | 201910168145.5 | 申请日: | 2019-03-06 |
公开(公告)号: | CN110532207A | 公开(公告)日: | 2019-12-03 |
发明(设计)人: | 黄之鸿;邱俊玮;张豪扬 | 申请(专利权)人: | 新唐科技股份有限公司 |
主分类号: | G06F13/38 | 分类号: | G06F13/38;G06F13/40 |
代理公司: | 11127 北京三友知识产权代理有限公司 | 代理人: | 王涛;任默闻<国际申请>=<国际公布>= |
地址: | 中国台湾新竹*** | 国省代码: | 中国台湾;TW |
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摘要: | |||
搜索关键词: | 从属元件 警示 控制线 汇流排系统 电性连接 增强序列 周边设备 主控元件 汇流排 电阻 接脚 介面 耦接 电源 检测 | ||
本发明提供一种汇流排系统以及其检测方法。汇流排系统包括主控元件、增强序列周边设备介面汇流排、经由该增强序列周边设备介面汇流排电性连接于该主控元件的多个从属元件以及一第一电阻。每一该从属元件具有一警示交握接脚。多个从属元件的该警示交握接脚是经由一警示交握控制线而电性连接在一起。第一电阻耦接于该警示交握控制线以及一电源之间。每一该从属元件是根据该警示交握控制线的一第一电压而得到多个从属元件的数量。
技术领域
本发明是有关于一种汇流排系统,且特别是有关于一种具有多个从属元件的汇流排系统。
背景技术
以往在电脑系统中,芯片组如南桥芯片(south bridge chip)是通过低接脚数(Low Pin Count,LPC)介面来与其他的电路模块,例如具不同功能的系统单芯片(System-on-a-chip,SoC)相电性连接。通过低接脚数介面连接的这些外接电路模块可分配到不同的独立位址,南桥芯片可因此以一对多的方式和外接电路模块通信。然而近年来,部分新提出的汇流排架构,例如增强序列周边设备介面(Enhanced Serial Peripheral Interface;eSPI)汇流排,仅允许芯片组和外接电路模块间以一对一的机制通信。
因此,需要知道共享汇流排的多个电路模块的数量,以便能对电性连接于芯片组的多个电路模块进行排程。
发明内容
本发明提供一种汇流排系统。该汇流排系统包括一主控元件、一增强序列周边设备介面汇流排、多个从属元件以及一第一电阻。多个从属元件是经由该增强序列周边设备介面汇流排电性连接于该主控元件。每一该从属元件具有一警示交握接脚,以及多个从属元件的该警示交握接脚是经由一警示交握控制线而电性连接在一起。该第一电阻耦接于该警示交握控制线以及一电源之间。每一该从属元件是根据该警示交握控制线的一第一电压而得到多个从属元件的数量。
再者,本发明提供另一种汇流排系统。该汇流排系统包括一主控元件、一增强序列周边设备介面汇流排、多个从属元件以及一上拉电阻。多个从属元件是经由该增强序列周边设备介面汇流排电性连接于该主控元件。每一该从属元件包括一警示交握接脚以及下拉电阻,其中该下拉电阻耦接于该警示交握接脚以及一接地端之间。该上拉电阻耦接于每一该从属元件的该警示交握接脚以及一电源之间。每一该从属元件是根据流经该下拉电阻的具有一第一电流值的一电流而得到多个从属元件的数量。
再者,本发明提供一种检测方法,用以检测一汇流排系统中多个从属元件的总数量。该汇流排系统更包括一上拉电阻以及经由一增强序列周边设备介面汇流排电性连接于多个从属元件的一主控元件。量测该从属元件的一警示交握接脚的一电压或是一电流,其中每一该从属元件的该警示交握接脚是经由该上拉电阻而电性耦接于一电源,以及该电流是从该警示交握接脚流至该从属元件内部的一下拉电阻。根据该警示交握接脚的该电压或该电流、该上拉电阻与该下拉电阻的电阻值以及该电源的电压值,得到多个从属元件的总数量。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1是显示根据本发明一些实施例所述的汇流排系统;
图2是显示根据本发明一些实施例所述的图1的汇流排系统的连接配置图;以及
图3是显示根据本发明一些实施例所述的检测方法,用以检测汇流排系统中从属元件的总数量。
附图标号:
1~汇流排系统(bus system);
10~主控元件(master device);
12~汇流排;
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