[发明专利]同步闪存U盘的启动方法及其控制系统有效

专利信息
申请号: 201410112035.4 申请日: 2014-03-25
公开(公告)号: CN103927131B 公开(公告)日: 2017-02-15
发明(设计)人: 唐剑 申请(专利权)人: 四川和芯微电子股份有限公司
主分类号: G06F3/06 分类号: G06F3/06;G06F13/10;G11C7/10
代理公司: 暂无信息 代理人: 暂无信息
地址: 610041 四川省*** 国省代码: 四川;51
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摘要:
搜索关键词: 同步 闪存 启动 方法 及其 控制系统
【权利要求书】:

1.一种同步闪存U盘的启动方法,其特征在于,包括如下步骤:

a.根据闪存控制器的起始读写时钟将固件的测试数据写至闪存数据缓存区;

b.根据闪存控制器的起始读写时钟将闪存数据缓存区的测试数据读至U盘控制器内存区;

c.对比闪存数据缓存区内的测试数据与U盘控制器内存区内的测试数据是否一致,并记录对比结果及读写时钟的相位参数;

d.闪存控制器的起始读写时钟延迟一个延迟单位,并重复步骤a至d;

e.当记录结果由一致跳变至不一致时,停止重复步骤d;

f.从记录结果为一致的连续区间选择一个结果对应的读写时钟相位参数确定U盘访问闪存的时钟相位,并根据该时钟的相位启动U盘。

2.如权利要求1所述的同步闪存U盘的启动方法,其特征在于,在所述步骤e中,当记录结果至少连续为两个不一致时,停止重复步骤d。

3.如权利要求2所述的同步闪存U盘的启动方法,其特征在于,所述步骤f具体为:

从记录结果为一致的连续区间选择中间结果对应的读写时钟相位参数确定U盘访问闪存的时钟的相位。

4.如权利要求3所述的同步闪存U盘的启动方法,其特征在于,所述步骤b具体为:所述U盘控制器内的倍频器输出一低频时钟至所述闪存控制器,且所述低频时钟作为所述闪存控制器的起始读写时钟;且所述倍频器输出一高频时钟至所述U盘控制器的延时电路,以配置闪存控制器输出的DQS的延迟,一数据锁存器根据延迟后的DQS对闪存控制器输出的测试数据进行采样,并将采样后的测试数据输入至所述U盘控制器内存区。

5.如权利要求4所述的同步闪存U盘的启动方法,其特征在于,所述延时电路根据所述高频时钟延迟DQS至少一个延迟单位,并输出延迟后的DQS至所述数据锁存器,且所述延迟单位为1个所述高频时钟周期。

6.如权利要求1所述的同步闪存U盘的启动方法,其特征在于,在所述步骤f中,当记录结果为一致的连续区间的结果数为单数时,选择中间结果对应的读写时钟相位参数确定U盘访问闪存的时钟的相位;当记录结果为一致的连续区间的结果数为双数时,选择两中间结果任意一个对应的读写时钟相位参数确定U盘访问闪存的时钟的相位。

7.如权利要求1-6任一项所述的同步闪存U盘的启动方法,其特征在于,还包括步骤j:当记录结果为一致的连续区间大于设定区间的上限时,增加闪存控制器的起始读写时钟的频率,重复步骤a至f。

8.如权利要求6所述的同步闪存U盘的启动方法,其特征在于,重复步骤j,当记录结果为一致的连续区间位于设定区间且小于设定区间的下限时,停止重复步骤j。

9.一种同步闪存U盘的控制系统,用于读取闪存的数据至U盘控制器内存区,其特征在于,包括倍频器、延时电路及数据锁存器,所述倍频器分别输出一高频时钟与一低频时钟,所述低频时钟输入至闪存控制器,且作为所述闪存控制器的起始读写时钟,所述高频时钟输入至所述延时电路,所述闪存控制器根据所述低频时钟输出数据采样脉冲至所述延时电路,所述延时电路根据所述高频时钟延迟数据采样脉冲至少一个延迟单位,并输出延迟后的数据采样脉冲至所述数据锁存器;所述闪存控制器根据所述低频时钟将其数据缓存区的测试数据输出至所述数据锁存器,所述数据锁存器根据输入的数据采样脉冲对输入的测试数据进行采样,并将采样后的测试数据输入至U盘控制器内存区。

10.如权利要求9所述的同步闪存U盘的控制系统,其特征在于,所述延迟单位为1个所述高频时钟周期。

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